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文件名称:verilog-stopwatch-master

  • 所属分类：
    VHDL/FPGA/Verilog
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2018-01-18
  • 文件大小：
    10kb
  • 已下载：
    0次
  • 提 供 者：
    n*****
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

verilog stop watch code for end user
相关搜索： verilog

(系统自动生成,下载前可以参看下载内容)

下载文件列表

文件名大小更新时间
verilog-stopwatch-master 0 2013-12-05
verilog-stopwatch-master\DE2_pin_assignments.csv 7876 2013-12-05
verilog-stopwatch-master\LICENSE 1091 2013-12-05
verilog-stopwatch-master\README.md 98 2013-12-05
verilog-stopwatch-master\bcd_counter.v 391 2013-12-05
verilog-stopwatch-master\ms_clock.v 313 2013-12-05
verilog-stopwatch-master\ms_clock_switched.v 407 2013-12-05
verilog-stopwatch-master\seven_sement_decoder.v 528 2013-12-05
verilog-stopwatch-master\stopwatch.qpf 1266 2013-12-05
verilog-stopwatch-master\stopwatch.qsf 22440 2013-12-05
verilog-stopwatch-master\stopwatch.v 1189 2013-12-05

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