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文件名称:fifo

  • 所属分类：
    VHDL/FPGA/Verilog
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2018-01-25
  • 文件大小：
    15kb
  • 已下载：
    0次
  • 提 供 者：
    yz***
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

基于verilog HDL的fifo设计与测试，包含设计与测试代码，以及简单的makefile编写。整个平台是基于linux操作，仿真平台是基于SYNOPSYS的vcs工具。(Based on verilog HDL fifo design and testing, including the design and test code, and simple makefile.The platform is based on Linux operating, the simulation platform is based on the VCS of SYNOPSYS tools.)
相关搜索： verilog fifo synopsys vcs Makefile linux

(系统自动生成,下载前可以参看下载内容)

下载文件列表

文件名大小更新时间
fifo\.nfs1746 3430 2015-06-15
fifo\cleanup 140 2015-06-15
fifo\fifo.sva 579 2015-06-15
fifo\fifo.v 3051 2015-06-15
fifo\fifo_tb.v 7121 2015-06-15
fifo\run_debug 21 2015-06-15
fifo\run_debug_all 25 2015-06-15
fifo\run_debug_sva 92 2015-06-15
fifo\run1.f 22 2015-06-15
fifo\run1sva.f 36 2015-06-15
fifo\start_over 0 2017-04-06
fifo\start_over\fifo.v 3051 2015-06-15
fifo\start_over\fifo_fix1 3046 2015-06-15
fifo\start_over\fifo_tb.v 7121 2015-06-15
fifo\start_over\run1.f 23 2015-06-15
fifo\vcdplus_trace.vpd 4235 2015-06-15

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