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文件名称:m60

  • 所属分类：
    VHDL/FPGA/Verilog
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2018-02-10
  • 文件大小：
    1kb
  • 已下载：
    0次
  • 提 供 者：
    guoe****
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
电信下载 联通下载
别用迅雷、360浏览器下载。
如迅雷强制弹出，可右键点击选“另存为”。
失败请重下，重下不扣分。
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

使用verilog实现模六十计数即0-1-2-3-4-5-.......-59-0-1-2的功能。(Use Verilog to realize the function of the mode sixty count, 0-1-2-3-4-5-....-59-0-1-2.)
相关搜索： 模60计数器

(系统自动生成,下载前可以参看下载内容)

下载文件列表

文件名大小更新时间
m60.v 1315 2017-11-30
test.v 1153 2017-11-30
test1.v 1045 2017-11-30

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