文件名称:dmc_verilog
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所属分类：
- 标签属性：
- 上传时间：2008-10-13
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文件大小：616.94kb
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提 供 者：
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相关连接：无下载说明：别用迅雷下载，失败请重下，重下不扣分！
介绍说明－－下载内容来自于网络，使用问题请自行百度
本示例中使用了一个DCM模块，将输入时钟50MHz，倍频到100MHz，分频到25MHz，不同的频率值通过LED进行演示。
(系统自动生成,下载前可以参看下载内容)
下载文件列表
xapp462_verilog/BUFG_CLK0_FB_SUBM.v
xapp462_verilog/BUFG_CLK0_SUBM.v
xapp462_verilog/BUFG_CLK2X_FB_SUBM.v
xapp462_verilog/BUFG_CLK2X_SUBM.v
xapp462_verilog/BUFG_CLKDV_SUBM.v
xapp462_verilog/BUFG_DFS_FB_SUBM.v
xapp462_verilog/BUFG_DFS_SUBM.v
xapp462_verilog/BUFG_PHASE_CLK0_SUBM.v
xapp462_verilog/BUFG_PHASE_CLK2X_SUBM.v
xapp462_verilog/BUFG_PHASE_CLKDV_SUBM.v
xapp462_verilog/BUFG_PHASE_CLKFX_FB_SUBM.v
xapp462_verilog/DCM_INST.v
xapp462_verilog/readme_dcm_verilog.txt
xapp462_verilog
xapp462.pdf
www.dssz.com.txt
xapp462_verilog/BUFG_CLK0_SUBM.v
xapp462_verilog/BUFG_CLK2X_FB_SUBM.v
xapp462_verilog/BUFG_CLK2X_SUBM.v
xapp462_verilog/BUFG_CLKDV_SUBM.v
xapp462_verilog/BUFG_DFS_FB_SUBM.v
xapp462_verilog/BUFG_DFS_SUBM.v
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xapp462_verilog/BUFG_PHASE_CLKDV_SUBM.v
xapp462_verilog/BUFG_PHASE_CLKFX_FB_SUBM.v
xapp462_verilog/DCM_INST.v
xapp462_verilog/readme_dcm_verilog.txt
xapp462_verilog
xapp462.pdf
www.dssz.com.txt
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