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文件名称:verilog_YUYAN

  • 所属分类：
    VHDL编程
  • 标签属性：
    [Text]
  • 上传时间：
    2008-10-13
  • 文件大小：
    49.08kb
  • 已下载：
    0次
  • 提 供 者：
    J***
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

verilog语言写的同步双端口设计文件!!!是一个不错的双口RAM的设计文件！
(系统自动生成,下载前可以参看下载内容)

下载文件列表

verilog语言写的同步双端口设计文件.jpg
www.dssz.com.txt

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