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文件名称:SIMTUT_TB.VHD

  • 所属分类：
    VHDL编程
  • 标签属性：
    [Text]
  • 上传时间：
    2008-10-13
  • 文件大小：
    13.07kb
  • 已下载：
    0次
  • 提 供 者：
    ****
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

用StateCAD设计一个“串进并出的加法器”状态机，并使用StateCAD测试激励生成器设计测试激励，验证该状态机，掌握完整的StateCAD设计流程.
(系统自动生成,下载前可以参看下载内容)

下载文件列表

StateCAD_Demo/SIMTUT_TB.HLF
StateCAD_Demo/SIMTUT_TB.REG
StateCAD_Demo/SIMTUT_TB.TMP
StateCAD_Demo/SIMTUT_TB.VHD
StateCAD_Demo/TUT.DIA
StateCAD_Demo/TUT.vhd
StateCAD_Demo/TUT_TB.HLF
StateCAD_Demo/TUT_TB.REG
StateCAD_Demo/TUT_TB.TMP
StateCAD_Demo/TUT_TB.VHD
StateCAD_Demo/_import.dmo
源文件/SIMTUT_TB.VHD
源文件/TUT.DIA
源文件/TUT.vhd
源文件/TUT_TB.VHD
StateCAD_Demo
源文件
www.dssz.com.txt

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