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文件名称:RISC

  • 所属分类：
    VHDL/FPGA/Verilog
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2019-06-17
  • 文件大小：
    4kb
  • 已下载：
    1次
  • 提 供 者：
    Phy****
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

URISC的RTL级设计，Verilog代码(Design: URISC RTL Verilog)
相关搜索： urisc

(系统自动生成,下载前可以参看下载内容)

下载文件列表

文件名大小更新时间
RISC\datapath.v 3688 2019-06-10
RISC\datapath.v.bak 3899 2019-06-10
RISC\urisc.v 2399 2019-06-10
RISC\urisc.v.bak 2424 2019-06-10
RISC\urisc_controller.v 4526 2019-06-10
RISC\urisc_ram.v 1009 2019-06-10
RISC\urisc_ram.v.bak 863 2019-06-10
RISC\urisc_test.v 491 2019-06-10
RISC\urisc_test.v.bak 489 2019-06-10
RISC 0 2019-06-10

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