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文件名称:32_bit_cpu

  • 所属分类:
  • 标签属性:
  • 上传时间:
    2008-10-13
  • 文件大小:
    792.73kb
  • 已下载:
    0次
  • 提 供 者:
  • 相关连接:
  • 下载说明:
    别用迅雷下载,失败请重下,重下不扣分!

介绍说明--下载内容来自于网络,使用问题请自行百度

两条5级的并行流水线,乘法器还有一个简单的中断系统(带一个中断管理的‘操作系统’吧),再加上一个编译器。

主要是说明一下CPU的设计方法,还有一些简单的模块例如加法器,乘法器
(系统自动生成,下载前可以参看下载内容)

下载文件列表

32位CPU设计/源程序/冒泡排序.txt
32位CPU设计/源程序/冒泡排序2.txt
32位CPU设计/源程序/冒泡排序3.txt
32位CPU设计/源程序/冒泡排序_ex.txt
32位CPU设计/源程序/简单操作系统.txt
32位CPU设计/源程序/选择法排序.txt
32位CPU设计/汇编器相关/Bin2Txt.exe
32位CPU设计/汇编器相关/WASM.exe
32位CPU设计/汇编器相关/首先用WASM编译,然后用Bin2Txt转换.txt
32位CPU设计/汇编器相关/WASM/WASM.dsw
32位CPU设计/汇编器相关/WASM/WASM.ncb
32位CPU设计/汇编器相关/WASM/WASM.opt
32位CPU设计/汇编器相关/WASM/WASM/WASM.CPP
32位CPU设计/汇编器相关/WASM/WASM/WASM.dsp
32位CPU设计/汇编器相关/WASM/WASM/WASM.H
32位CPU设计/汇编器相关/WASM/WASM/WASM.plg
32位CPU设计/汇编器相关/WASM/Bin2Txt/Bin2Txt.cpp
32位CPU设计/汇编器相关/WASM/Bin2Txt/Bin2Txt.dsp
32位CPU设计/汇编器相关/WASM/Bin2Txt/Bin2Txt.plg
32位CPU设计/Super/Adder32.v
32位CPU设计/Super/ALU.v
32位CPU设计/Super/CtrlUnit.v
32位CPU设计/Super/FlagReg.v
32位CPU设计/Super/GET_OPER.v
32位CPU设计/Super/IMME_EX.v
32位CPU设计/Super/INS_DECODER.v
32位CPU设计/Super/IRLoader.v
32位CPU设计/Super/J_PATH.v
32位CPU设计/Super/Mul16.v
32位CPU设计/Super/MUXx1.v
32位CPU设计/Super/Ram.v
32位CPU设计/Super/Reg32.v
32位CPU设计/Super/RegGroup32.v
32位CPU设计/Super/Super.v
32位CPU设计/Super/SysIns.v
32位CPU设计/Super/test.txt
32位CPU设计/Super/指令编码.txt
32位CPU设计/Super/汇编代码.txt
32位CPU设计/Super/说明.txt
32位CPU设计/Super/work/_info
32位CPU设计/Super/work/@to@jmp/verilog.asm
32位CPU设计/Super/work/@to@jmp/_primary.dat
32位CPU设计/Super/work/@to@jmp/_primary.vhd
32位CPU设计/Super/work/@sys@ins@ctrl/verilog.asm
32位CPU设计/Super/work/@sys@ins@ctrl/_primary.dat
32位CPU设计/Super/work/@sys@ins@ctrl/_primary.vhd
32位CPU设计/Super/work/@super@c@p@u/verilog.asm
32位CPU设计/Super/work/@super@c@p@u/_primary.dat
32位CPU设计/Super/work/@super@c@p@u/_primary.vhd
32位CPU设计/Super/work/@shift64_32/verilog.asm
32位CPU设计/Super/work/@shift64_32/_primary.dat
32位CPU设计/Super/work/@shift64_32/_primary.vhd
32位CPU设计/Super/work/@shift32/verilog.asm
32位CPU设计/Super/work/@shift32/_primary.dat
32位CPU设计/Super/work/@shift32/_primary.vhd
32位CPU设计/Super/work/@s@y@s_@i@n@s_@d@e@c@o@d@e@r/verilog.asm
32位CPU设计/Super/work/@s@y@s_@i@n@s_@d@e@c@o@d@e@r/_primary.dat
32位CPU设计/Super/work/@s@y@s_@i@n@s_@d@e@c@o@d@e@r/_primary.vhd
32位CPU设计/Super/work/@reg@group32v3/verilog.asm
32位CPU设计/Super/work/@reg@group32v3/_primary.dat
32位CPU设计/Super/work/@reg@group32v3/_primary.vhd
32位CPU设计/Super/work/@reg@group32v2/verilog.asm
32位CPU设计/Super/work/@reg@group32v2/_primary.dat
32位CPU设计/Super/work/@reg@group32v2/_primary.vhd
32位CPU设计/Super/work/@reg@group32/verilog.asm
32位CPU设计/Super/work/@reg@group32/_primary.dat
32位CPU设计/Super/work/@reg@group32/_primary.vhd
32位CPU设计/Super/work/@reg@flag/verilog.asm
32位CPU设计/Super/work/@reg@flag/_primary.dat
32位CPU设计/Super/work/@reg@flag/_primary.vhd
32位CPU设计/Super/work/@reg32v2/verilog.asm
32位CPU设计/Super/work/@reg32v2/_primary.dat
32位CPU设计/Super/work/@reg32v2/_primary.vhd
32位CPU设计/Super/work/@reg32/verilog.asm
32位CPU设计/Super/work/@reg32/_primary.dat
32位CPU设计/Super/work/@reg32/_primary.vhd
32位CPU设计/Super/work/@reg16/verilog.asm
32位CPU设计/Super/work/@reg16/_primary.dat
32位CPU设计/Super/work/@reg16/_primary.vhd
32位CPU设计/Super/work/@ram/verilog.asm
32位CPU设计/Super/work/@ram/_primary.dat
32位CPU设计/Super/work/@ram/_primary.vhd
32位CPU设计/Super/work/@r@s@reg/verilog.asm
32位CPU设计/Super/work/@r@s@reg/_primary.dat
32位CPU设计/Super/work/@r@s@reg/_primary.vhd
32位CPU设计/Super/work/@pre@read/verilog.asm
32位CPU设计/Super/work/@pre@read/_primary.dat
32位CPU设计/Super/work/@pre@read/_primary.vhd
32位CPU设计/Super/work/@mult16_@m/verilog.asm
32位CPU设计/Super/work/@mult16_@m/_primary.dat
32位CPU设计/Super/work/@mult16_@m/_primary.vhd
32位CPU设计/Super/work/@m@u@x8/verilog.asm
32位CPU设计/Super/work/@m@u@x8/_primary.dat
32位CPU设计/Super/work/@m@u@x8/_primary.vhd
32位CPU设计/Super/work/@m@u@x4x8/verilog.asm
32位CPU设计/Super/work/@m@u@x4x8/_primary.dat
32位CPU设计/Super/work/@m@u@x4x8/_primary.vhd
32位CPU设计/Super/work/@m@u@x4x4/verilog.asm
32位CPU设计/Super/work/@m@u@x4x4/_primary.dat
32位CPU设计/Super/work/@m@u@x4x4/_primary.vhd
32位CPU设计/Super/work/@m@u@x4x1/verilog.asm
32位CPU设计/Super/work/@m@u@x4x1/_primary.dat
32位CPU设计/Super/work/@m@u@x4x1/_primary.vhd
32位CPU设计/Super/work/@m@u@x4/verilog.asm
32位CPU设计/Super/work/@m@u@x4/_primary.dat
32位CPU设计/Super/work/@m@u@x4/_primary.vhd
32位CPU设计/Super/work/@m@u@x32x32test/verilog.asm
32位CPU设计/Super/work/@m@u@x32x32test/_primary.dat
32位CPU设计/Super/work/@m@u@x32x32test/_primary.vhd
32位CPU设计/Super/work/@m@u@x32x32/verilog.asm
32位CPU设计/Super/work/@m@u@x32x32/_primary.dat
32位CPU设计/Super/work/@m@u@x32x32/_primary.vhd
32位CPU设计/Super/work/@m@u@x32sp/verilog.asm
32位CPU设计/Super/work/@m@u@x32sp/_primary.dat
32位CPU设计/Super/work/@m@u@x32sp/_primary.vhd
32位CPU设计/Super/work/@m@u@x32/verilog.asm
32位CPU设计/Super/work/@m@u@x32/_primary.dat
32位CPU设计/Super/work/@m@u@x32/_primary.vhd
32位CPU设计/Super/work/@m@u@x2_16/verilog.asm
32位CPU设计/Super/work/@m@u@x2_16/_primary.dat
32位CPU设计/Super/work/@m@u@x2_16/_primary.vhd
32位CPU设计/Super/work/@m@u@x2/verilog.asm
32位CPU设计/Super/work/@m@u@x2/_primary.dat
32位CPU设计/Super/work/@m@u@x2/_primary.vhd
32位CPU设计/Super/work/@logic32/verilog.asm
32位CPU设计/Super/work/@logic32/_primary.dat
32位CPU设计/Super/work/@logic32/_primary.vhd
32位CPU设计/Super/work/@j_@p@a@t@h/verilog.asm
32位CPU设计/Super/work/@j_@p@a@t@h/_primary.dat
32位CPU设计/Super/work/@j_@p@a@t@h/_primary.vhd
32位CPU设计/Super/work/@ins@reg/verilog.asm
32位CPU设计/Super/work/@ins@reg/_primary.dat
32位CPU设计/Super/work/@

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