文件名称:异步FIFO
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- 上传时间:2020-11-10
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纯Verilog实现的异步FIFO,分为读写控制模块,SRAM CORE,同步等几个模块,内含源文件和仿真文件(The asynchronous FIFO implemented by Verilog is divided into read-write control module, SRAM core module and synchronization module)
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下载文件列表
文件名 | 大小 | 更新时间 |
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异步FIFO\bin2gray.v | 328 | 2020-10-19 |
异步FIFO\dual_ram.v | 638 | 2020-10-19 |
异步FIFO\fifo_tb.v | 1250 | 2020-10-19 |
异步FIFO\file.list | 81 | 2020-10-21 |
异步FIFO\makefile | 229 | 2020-10-19 |
异步FIFO\read_con.v | 654 | 2020-10-19 |
异步FIFO\syn.v | 816 | 2020-10-19 |
异步FIFO\top.v | 1531 | 2020-10-19 |
异步FIFO\write_con.v | 713 | 2020-10-19 |
异步FIFO | 0 | 2020-11-10 |
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