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文件名称:verilog32位浮点数乘法器

  • 所属分类：
    VHDL编程
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2010-12-15
  • 文件大小：
    2.08kb
  • 已下载：
    6次
  • 提 供 者：
    hustwt
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

采用verilog写的32位浮点数乘法器，组合电路，只需要一个时钟周期就可完成运算
相关搜索： verilog 浮点数乘法器

(系统自动生成,下载前可以参看下载内容)

下载文件列表

压缩包 : float_mul_verilog.rar 列表
mul.v
ReaMe.txt

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