文件名称:实用verilog代码(乘法器,触发器,FIFO等)
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- 上传时间:2010-12-18
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本文件包含一些实用verilog程序代码,包括乘法器,除法器,伽罗瓦域乘法器,CORDIC数字计算机的设计,异步FIFO设计,伪随机序列应用设计,RS(204,188)译码器的设计,都是可综合的。对研究这部分的朋友有一定的帮助。
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压缩包 : 实例程序代码.rar 列表 实例程序代码\第15章 常用加法器设计\carry_chain_adder.v 实例程序代码\第15章 常用加法器设计\carry_skip_adder.v 实例程序代码\第15章 常用加法器设计\ripple_carry_adder.v 实例程序代码\第15章 常用加法器设计\transcript 实例程序代码\第16章 常用乘法器设计\basic_base2_mul.v 实例程序代码\第16章 常用乘法器设计\basic_base2_mul_seq.v 实例程序代码\第16章 常用乘法器设计\carry_save_mult.v 实例程序代码\第16章 常用乘法器设计\ripple_carry_mult.v 实例程序代码\第17章 伽罗华域GF(q)乘法器设计\ff_const_mul.v 实例程序代码\第17章 伽罗华域GF(q)乘法器设计\ff_mul.v 实例程序代码\第18章 除法器设计\rest_div_int.v 实例程序代码\第18章 除法器设计\seq_div.v 实例程序代码\第19章 积分梳状滤波器(CIC)设计\cic3_decimator.v 实例程序代码\第20章 CORDIC数字计算机的设计\cordic.v 实例程序代码\第21章 伪随机序列应用设计\randomization.v 实例程序代码\第22章 异步FIFO设计\async_cmp.v 实例程序代码\第22章 异步FIFO设计\async_fifo.v 实例程序代码\第22章 异步FIFO设计\dp_ram.v 实例程序代码\第22章 异步FIFO设计\rptr_empty.v 实例程序代码\第22章 异步FIFO设计\wptr_full.v 实例程序代码\第23章 RS(204,188)译码器的设计\BM_KES.v 实例程序代码\第23章 RS(204,188)译码器的设计\CheinSearch.v 实例程序代码\第23章 RS(204,188)译码器的设计\ff_mul.v 实例程序代码\第23章 RS(204,188)译码器的设计\forney.v 实例程序代码\第23章 RS(204,188)译码器的设计\ROM_INV.mif 实例程序代码\第23章 RS(204,188)译码器的设计\rom_inv.v 实例程序代码\第23章 RS(204,188)译码器的设计\rom_power.mif 实例程序代码\第23章 RS(204,188)译码器的设计\rom_power.v 实例程序代码\第23章 RS(204,188)译码器的设计\RS(204,188)译码器说明.txt 实例程序代码\第23章 RS(204,188)译码器的设计\rs_decoder.v 实例程序代码\第23章 RS(204,188)译码器的设计\SyndromeCalc.v 实例程序代码\第15章 常用加法器设计 实例程序代码\第16章 常用乘法器设计 实例程序代码\第17章 伽罗华域GF(q)乘法器设计 实例程序代码\第18章 除法器设计 实例程序代码\第19章 积分梳状滤波器(CIC)设计 实例程序代码\第20章 CORDIC数字计算机的设计 实例程序代码\第21章 伪随机序列应用设计 实例程序代码\第22章 异步FIFO设计 实例程序代码\第23章 RS(204,188)译码器的设计 实例程序代码
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