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文件名称:CPUverilog

  • 所属分类：
    VHDL编程
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2008-10-13
  • 文件大小：
    24.53kb
  • 已下载：
    0次
  • 提 供 者：
    詹****
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

pic cpu source code. it is writed in the verilog source code. it can work on the 40Mhz high speed.
(系统自动生成,下载前可以参看下载内容)

下载文件列表

verilog/CVS/Root
verilog/CVS/Repository
verilog/CVS/Template
verilog/CVS/Entries.Old
verilog/CVS/Entries
verilog/CVS/Entries.Extra.Old
verilog/CVS/Entries.Extra
verilog/CVS/Entries.Log
verilog/CVS
verilog/core/CVS/Root
verilog/core/CVS/Repository
verilog/core/CVS/Template
verilog/core/CVS/Entries.Old
verilog/core/CVS/Entries
verilog/core/CVS/Entries.Extra.Old
verilog/core/CVS/Entries.Extra
verilog/core/CVS
verilog/core/alu.v
verilog/core/presclr_wdt.v
verilog/core/primitives.v
verilog/core/primitives_xilinx.v
verilog/core/register_file.v
verilog/core/risc_core.v
verilog/core/risc_core_top.v
verilog/core
verilog/testbench/CVS/Root
verilog/testbench/CVS/Repository
verilog/testbench/CVS/Template
verilog/testbench/CVS/Entries.Old
verilog/testbench/CVS/Entries
verilog/testbench/CVS/Entries.Extra.Old
verilog/testbench/CVS/Entries.Extra
verilog/testbench/CVS
verilog/testbench/prog_mem.v
verilog/testbench/test.v
verilog/testbench
verilog
www.dssz.com.txt

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