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文件名称:jdcbzh.使用VHDL语言实现串并转换模块的实现

  • 所属分类：
    VHDL编程
  • 标签属性：
    [Text]
  • 上传时间：
    2012-08-31
  • 文件大小：
    1.32kb
  • 已下载：
    0次
  • 提 供 者：
    吴***
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

使用VHDL语言实现串并转换模块的实现，可在QUARTUS上实现,Use VHDL language string and conversion module, but in QUARTUS
相关搜索： 串并转换

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[FPGA][VHDL]简单的并串转换程序_阿虚的电子小屋.txt

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