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文件名称:USB2.0-IP-core

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [PDF]
  • 上传时间：
    2012-09-04
  • 文件大小：
    196.19kb
  • 已下载：
    0次
  • 提 供 者：
    柳****
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

用verilog 写的USB2.0，含源码。从别处找来的，不敢独享，希望对大家有帮助-Written by verilog USB2.0, including source code. Recruited from elsewhere, and not exclusive, we want to help
(系统自动生成,下载前可以参看下载内容)

下载文件列表

USB2.0 IP核/usb_funct/bench/CVS/Entries
USB2.0 IP核/usb_funct/bench/CVS/Repository
USB2.0 IP核/usb_funct/bench/CVS/Root
USB2.0 IP核/usb_funct/bench/verilog/CVS/Entries
USB2.0 IP核/usb_funct/bench/verilog/CVS/Repository
USB2.0 IP核/usb_funct/bench/verilog/CVS/Root
USB2.0 IP核/usb_funct/doc/CVS/Entries
USB2.0 IP核/usb_funct/doc/CVS/Repository
USB2.0 IP核/usb_funct/doc/CVS/Root
USB2.0 IP核/usb_funct/doc/README.txt
USB2.0 IP核/usb_funct/doc/STATUS.txt
USB2.0 IP核/usb_funct/doc/usb_doc.pdf
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USB2.0 IP核/usb_funct/rtl/CVS/Repository
USB2.0 IP核/usb_funct/rtl/CVS/Root
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USB2.0 IP核/usb_funct/syn/CVS/Repository
USB2.0 IP核/usb_funct/syn/CVS/Root
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USB2.0 IP核/usb_funct/sim/rtl_sim/bin
USB2.0 IP核/usb_funct/sim/rtl_sim/CVS
USB2.0 IP核/usb_funct/sim/rtl_sim/run
USB2.0 IP核/usb_funct/syn/bin/CVS
USB2.0 IP核/usb_funct/syn/log/CVS
USB2.0 IP核/usb_funct/syn/out/CVS
USB2.0 IP核/usb_funct/syn/run/CVS
USB2.0 IP核/usb_funct/bench/CVS
USB2.0 IP核/usb_funct/bench/verilog
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USB2.0 IP核/usb_funct/rtl/CVS
USB2.0 IP核/usb_funct/rtl/verilog
USB2.0 IP核/usb_funct/sim/CVS
USB2.0 IP核/usb_funct/sim/rtl_sim
USB2.0 IP核/usb_funct/syn/bin
USB2.0 IP核/usb_funct/syn/CVS
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USB2.0 IP核/usb_funct/syn/out
USB2.0 IP核/usb_funct/syn/run
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USB2.0 IP核/usb_funct/doc
USB2.0 IP核/usb_funct/rtl
USB2.0 IP核/usb_funct/sim
USB2.0 IP核/usb_funct/syn
USB2.0 IP核/usb_funct
USB2.0 IP核

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