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文件名称:使用verilog hdl实现16位的cpu设计

  • 所属分类：
    VHDL编程
  • 标签属性：
    [WORD]
  • 上传时间：
    2012-09-04
  • 文件大小：
    430.24kb
  • 已下载：
    1次
  • 提 供 者：
    gime****
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

实现16位的cpu设计 内容使用verilog hdl实现，具体的实现步骤方法，都已经写到文档里面去了！,To achieve 16-bit design of the contents of the cpu using verilog hdl achieve, the specific methods to achieve these steps have already been written inside the document went to!
相关搜索： vhdl cpu 16 vhdl 16c CPU 设计 cpu design using vhdl 16 bit cpu verilog verilog CPU 16 cpu

(系统自动生成,下载前可以参看下载内容)

下载文件列表

16位cpu设计/CPU.v
16位cpu设计/decoder.v
16位cpu设计/ram.v
16位cpu设计/RISC_CPU设计练习.doc
16位cpu设计/rom.v
16位cpu设计/test1.dat
16位cpu设计/test1.pro
16位cpu设计/test2.dat
16位cpu设计/test2.pro
16位cpu设计/test3.dat
16位cpu设计/test3.pro
16位cpu设计/test4.dat
16位cpu设计/test4.pro
16位cpu设计/test5.dat
16位cpu设计/test5.PRO
16位cpu设计/test.v
16位cpu设计/vsim.wlf
16位cpu设计/模拟结果.txt
16位cpu设计/说明.txt
16位cpu设计

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