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文件名称:CAN_IP.rar

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2012-09-04
  • 文件大小：
    59.84kb
  • 已下载：
    2次
  • 提 供 者：
    普****
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

这是CAN总线控制器的IP核，源码是由Verilog HDL编写的。其硬件结构与SJA1000类似，满足CAN2.0B协议。,This is a IP core of the CAN bus controller written by the Verilog HDL. whose structure is similar with SJA1000,supporting the　protocol of CAN2.0B.
相关搜索： CAN CAN BUS verilog

(系统自动生成,下载前可以参看下载内容)

下载文件列表

CAN/rtl/verilog/can_register.v
CAN/rtl/verilog/can_register_syn.v
CAN/rtl/verilog/README.txt
CAN/rtl/verilog/can_bsp.v
CAN/rtl/verilog/can_ibo.v
CAN/rtl/verilog/can_crc.v
CAN/rtl/verilog/can_acf.v
CAN/rtl/verilog/can_registers.v
CAN/rtl/verilog/can_register_asyn_syn.v
CAN/rtl/verilog/can_fifo.v
CAN/rtl/verilog/can_defines.v
CAN/rtl/verilog/can_btl.v
CAN/rtl/verilog/can_register_asyn.v
CAN/rtl/verilog/can_top.v
CAN/rtl/verilog/CVS/Repository
CAN/rtl/verilog/CVS/Entries
CAN/rtl/verilog/CVS/Root
CAN/bench/verilog/can_testbench.v
CAN/bench/verilog/can_testbench_defines.v
CAN/bench/verilog/timescale.v
CAN/bench/verilog/CVS/Repository
CAN/bench/verilog/CVS/Entries
CAN/bench/verilog/CVS/Root
CAN/rtl/verilog/CVS
CAN/bench/verilog/CVS
CAN/rtl/verilog
CAN/bench/verilog
CAN/rtl
CAN/bench
CAN

相关说明

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