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文件名称:pipelined-mips-cpu

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2012-09-04
  • 文件大小：
    167kb
  • 已下载：
    6次
  • 提 供 者：
    jack*****
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

用verilog语言描述了MIPS的5级流水线。-Language described by verilog MIPS 5-stage pipeline.
相关搜索： Pipelined CPU Veril

(系统自动生成,下载前可以参看下载内容)

下载文件列表

pipelined-mips-cpu/Adder.v
pipelined-mips-cpu/ALU.v
pipelined-mips-cpu/ALU_Control.v
pipelined-mips-cpu/Control.v
pipelined-mips-cpu/Data_Memory.v
pipelined-mips-cpu/Equal.v
pipelined-mips-cpu/EX_MEM.v
pipelined-mips-cpu/Forwarding.v
pipelined-mips-cpu/Hazard_Detection.v
pipelined-mips-cpu/ID_EX.v
pipelined-mips-cpu/IF_ID.v
pipelined-mips-cpu/Instr_Memory.v
pipelined-mips-cpu/MEM_WB.v
pipelined-mips-cpu/MUX_10bit.v
pipelined-mips-cpu/MUX_2x32bit.v
pipelined-mips-cpu/MUX_3x32bit.v
pipelined-mips-cpu/MUX_5bit.v
pipelined-mips-cpu/PC.v
pipelined-mips-cpu/Pipelined_CPU.v
pipelined-mips-cpu/Register_File.v
pipelined-mips-cpu/Sign_Extend.v
pipelined-mips-cpu/Testbench.v
pipelined-mips-cpu

相关说明

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