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文件名称:DE0_ruanhe

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2012-10-20
  • 文件大小：
    23.68mb
  • 已下载：
    0次
  • 提 供 者：
    任****
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    无
  • 下载说明：
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NIOS_SOPC/.sopc_builder/filters.xml
NIOS_SOPC/.sopc_builder/install.ptf
NIOS_SOPC/.sopc_builder/install2.ptf
NIOS_SOPC/.sopc_builder/preferences.xml
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NIOS_SOPC/altpllpll.qip
NIOS_SOPC/altpllpll.v
NIOS_SOPC/altpllpll_bb.v
NIOS_SOPC/altpllpll_wave0.jpg
NIOS_SOPC/altpllpll_waveforms.html
NIOS_SOPC/buttons.v
NIOS_SOPC/clock_crossing.v
NIOS_SOPC/cpu.ocp
NIOS_SOPC/cpu.sdc
NIOS_SOPC/cpu.v
NIOS_SOPC/cpu_bht_ram.mif
NIOS_SOPC/cpu_dc_tag_ram.mif
NIOS_SOPC/cpu_ic_tag_ram.mif
NIOS_SOPC/cpu_jtag_debug_module_sysclk.v
NIOS_SOPC/cpu_jtag_debug_module_tck.v
NIOS_SOPC/cpu_jtag_debug_module_wrapper.v
NIOS_SOPC/cpu_mult_cell.v
NIOS_SOPC/cpu_ociram_default_contents.mif
NIOS_SOPC/cpu_oci_test_bench.v
NIOS_SOPC/cpu_rf_ram_a.mif
NIOS_SOPC/cpu_rf_ram_b.mif
NIOS_SOPC/cpu_test_bench.v
NIOS_SOPC/db/
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