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文件名称:aescore

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [PDF]
  • 上传时间：
    2012-10-26
  • 文件大小：
    191.06kb
  • 已下载：
    1次
  • 提 供 者：
    李***
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

基于FPGA的AES算法实现的VERILOG源代码，对于信息安全专业研究AES算法的硬件实现很有用-FPGA-based AES algorithm implementation VERILOG source code, for the information security professional research of the hardware implementation of AES algorithm is useful
相关搜索： VHDL code of AES AES verilog op aes verilog code aes Verilog AES in VHDL Verilog AES AES based algorithm

(系统自动生成,下载前可以参看下载内容)

下载文件列表

aes core/aes.pdf
aes core/aes_core/bench/verilog/test_bench_top.v
aes core/aes_core/doc/aes.pdf
aes core/aes_core/rtl/verilog/aes_cipher_top.v
aes core/aes_core/rtl/verilog/aes_inv_cipher_top.v
aes core/aes_core/rtl/verilog/aes_inv_sbox.v
aes core/aes_core/rtl/verilog/aes_key_expand_128.v
aes core/aes_core/rtl/verilog/aes_rcon.v
aes core/aes_core/rtl/verilog/aes_sbox.v
aes core/aes_core/rtl/verilog/timescale.v
aes core/aes_core/rtl/verilog/transcript
aes core/aes_core/sim/rtl_sim/bin/Makefile
aes core/aes_core/sim/rtl_sim/run/waves/waves.do
aes core/aes_core/syn/bin/comp.dc
aes core/aes_core/syn/bin/design_spec.dc
aes core/aes_core/syn/bin/lib_spec.dc
aes core/aes_core/syn/bin/read.dc
aes core/aes_core/vim_session.vim
aes core/aes_core.tar.gz
aes core/OPENCORES.files/dotty.gif
aes core/OPENCORES.files/title_logo.gif
aes core/OPENCORES.htm
aes core/aes_core/sim/rtl_sim/run/waves
aes core/aes_core/sim/rtl_sim/bin
aes core/aes_core/sim/rtl_sim/run
aes core/aes_core/bench/verilog
aes core/aes_core/rtl/verilog
aes core/aes_core/sim/rtl_sim
aes core/aes_core/syn/bin
aes core/aes_core/bench
aes core/aes_core/doc
aes core/aes_core/rtl
aes core/aes_core/sim
aes core/aes_core/syn
aes core/aes_core
aes core/OPENCORES.files
aes core

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