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文件名称:clk_vhdl

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
  • 上传时间：
    2012-10-29
  • 文件大小：
    637.44kb
  • 已下载：
    1次
  • 提 供 者：
    kg2***
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

Quartus II工程压缩文件，是一个典型的基于FPGA的数字钟工程项目，有50MHz分频、计数、译码等模块。采用VHDL语言编写。-Quartus II project files, is a typical FPGA-based digital clock project, there are sub-50MHz frequency, counting, decoding modules. Using VHDL language.
相关搜索： Quartus II clock using FPGA 数字钟 fpga vhdl project vhdl digital clock using VHDL Quartus . clk_vhdl.rar

(系统自动生成,下载前可以参看下载内容)

下载文件列表

clk_vhdl.qar

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