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文件名称:Sequence-detector-design

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [WORD]
  • 上传时间：
    2012-11-01
  • 文件大小：
    30.46kb
  • 已下载：
    1次
  • 提 供 者：
    l****
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

序列检测器设计的思路大多都是用FSM来实现的,此思路是通过移位寄存器来实现序列检测-Sequence detector design ideas are often used to achieve the FSM, the idea is to achieve through the shift register sequence detection
相关搜索： sequence detector veril fsm sequence detector fsm sequence detector 序列检测器 sequence detector using shift register

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序列检测器的设计.doc

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