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文件名称:four_adder

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [HTML]
  • 上传时间：
    2012-11-03
  • 文件大小：
    145.67kb
  • 已下载：
    0次
  • 提 供 者：
    安***
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

应用一位全加器的VHDL语言，创建一位全加器符号，用原理图完成四位全加器-Application of a full adder VHDL language, to create a full-adder symbol, with the principle of the completion of four full adder diagram
相关搜索： 四位全加器 vhdl full adder

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four_adder/
four_adder/adder.bsf
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four_adder/db/four_adder.(0).cnf.cdb
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four_adder/db/four_adder.sld_design_entry_dsc.sci
four_adder/db/four_adder.syn_hier_info
four_adder/db/four_adder.tan.qmsg
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four_adder/four_adder.map.summary
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four_adder/four_adder.qpf
four_adder/four_adder.qsf
four_adder/four_adder.qws
four_adder/four_adder.sim.rpt
four_adder/four_adder.tan.rpt
four_adder/four_adder.tan.summary
four_adder/four_adder.vwf
four_adder/incremental_db/
four_adder/incremental_db/compiled_partitions/
four_adder/incremental_db/compiled_partitions/four_adder.root_partition.map.kpt
four_adder/incremental_db/README

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