文件名称:fir
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- 上传时间:2012-11-07
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利用FPGA中verlog HDL实现FIR滤波功能,可自行设置相关参数,生成模块-Verlog HDL in the use of FPGA realization of FIR filtering, the provision of the relevant parameters can generate module
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fir/FIR设计107101286.doc
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