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文件名称:Verilog

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2012-11-07
  • 文件大小：
    52.88kb
  • 已下载：
    5次
  • 提 供 者：
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

基于Verilog HDL的通信系统设计一书的源代码，大家可以下载，参考一下-Verilog HDL-based communication system design of the book source code, you can download, refer to
(系统自动生成,下载前可以参看下载内容)

下载文件列表

Verilog源代码/chapter10/11.2节/DESCRAMBLER.v
Verilog源代码/chapter10/11.2节/PARALLEL_SCRAMBLER.v
Verilog源代码/chapter10/11.2节/PARALLEL_SCRAM_TEST.v
Verilog源代码/chapter10/11.2节/PARALLER_DESCRAMBLER.v
Verilog源代码/chapter10/11.2节/SCRAMBLER.v
Verilog源代码/chapter10/11.2节/SCRAM_TEST.v
Verilog源代码/chapter10/11.3节/CRC16.v
Verilog源代码/chapter10/11.3节/CRC_16_PARALLEL.v
Verilog源代码/chapter10/11.4节/SDH_STM1.v
Verilog源代码/chapter10/11.5节/DECODE_8B_10B.v
Verilog源代码/chapter10/11.5节/ENCODE_8B_10B.v
Verilog源代码/chapter4/add_full.v
Verilog源代码/chapter4/add_half.v
Verilog源代码/chapter4/count16.v
Verilog源代码/chapter4/decode3to8.v
Verilog源代码/chapter4/fifo3.v
Verilog源代码/chapter4/fre13.v
Verilog源代码/chapter4/mult1from8.v
Verilog源代码/chapter4/ram_4_4.v
Verilog源代码/chapter4/rom_16_4.v
Verilog源代码/chapter4/ser_to_parr.v
Verilog源代码/chapter4/trigger_d.v
Verilog源代码/chapter4/trigger_jk.v
Verilog源代码/chapter4/trigger_rs.v
Verilog源代码/chapter5/cic_filter_3__28_ho.v
Verilog源代码/chapter5/cic_insert_3_2_8_ho.v
Verilog源代码/chapter5/decimate_4.v
Verilog源代码/chapter5/fir_lp_8.v
Verilog源代码/chapter5/fir_parr_8.v
Verilog源代码/chapter5/iir_cascade_2.v
Verilog源代码/chapter5/iir_filter_8.v
Verilog源代码/chapter5/insert_4.v
Verilog源代码/chapter6/ask_2.v
Verilog源代码/chapter6/ask_2_de.v
Verilog源代码/chapter6/fsk_2.v
Verilog源代码/chapter6/fsk_2_de.v
Verilog源代码/chapter6/ppm.v
Verilog源代码/chapter6/ppm_de.v
Verilog源代码/chapter6/psk_2.v
Verilog源代码/chapter6/psk_2_de.v
Verilog源代码/chapter6/qpsk.v
Verilog源代码/chapter6/qpsk_de.v
Verilog源代码/chapter7/CONTROLLER.v
Verilog源代码/chapter7/CSEEBLOCK.v
Verilog源代码/chapter7/KESBLOCK.V
Verilog源代码/chapter7/RSDECODER.v
Verilog源代码/chapter7/RS_ENCODER.V
Verilog源代码/chapter7/SCBLOCK.V
Verilog源代码/chapter8/8.2节/GENSQUE.v
Verilog源代码/chapter8/8.2节/GOLD_SQUE_GEN.v
Verilog源代码/chapter8/8.3节/SPR_SPECTRUM_MOD.v
Verilog源代码/chapter8/8.4节/CATCH_TOP.v
Verilog源代码/chapter8/8.4节/CATCH_TOP.v.bak
Verilog源代码/chapter8/8.4节/GATE_CONTROL.v
Verilog源代码/chapter8/8.4节/GATE_CONTROL.v.bak
Verilog源代码/chapter8/8.4节/GENSQUE.v
Verilog源代码/chapter8/8.4节/GENSQUE.v.bak
Verilog源代码/chapter8/8.4节/SERIAL_SOLVE.v
Verilog源代码/chapter8/8.4节/SERIAL_SOLVE.v.bak
Verilog源代码/chapter8/8.4节/SERIAL_TO_PARALLEL.v
Verilog源代码/chapter8/8.4节/SERIAL_TO_PARALLEL.v.bak
Verilog源代码/chapter8/8.4节/TESTBENCH.v
Verilog源代码/chapter8/8.4节/TESTBENCH.v.bak
Verilog源代码/chapter9/BAUD_GENERATER.v
Verilog源代码/chapter9/SERIAL_CONTROLLER.v
Verilog源代码/chapter9/UART_RECEIVER.v
Verilog源代码/chapter9/UART_TRANSMITTER.v
Verilog源代码/chapter10/11.2节
Verilog源代码/chapter10/11.3节
Verilog源代码/chapter10/11.4节
Verilog源代码/chapter10/11.5节
Verilog源代码/chapter8/8.2节
Verilog源代码/chapter8/8.3节
Verilog源代码/chapter8/8.4节
Verilog源代码/chapter10
Verilog源代码/chapter4
Verilog源代码/chapter5
Verilog源代码/chapter6
Verilog源代码/chapter7
Verilog源代码/chapter8
Verilog源代码/chapter9
Verilog源代码

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