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文件名称:MyProject

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [WORD]
  • 上传时间：
    2012-11-16
  • 文件大小：
    219.54kb
  • 已下载：
    0次
  • 提 供 者：
    zh***
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

3-8译码器的仿真实验。本实验选用的仿真开发软件是MAX+plus II Version 9.3，原理图源文件保存在MyProject目录中，为138decoder.gdf，另有我写的实验报告，呵呵，适合仿真入门-3-8 decoder simulation. Selected in this experiment simulation software is MAX+ Plus II Version 9.3, schematic source files stored in the MyProject directory for 138decoder.gdf, otherwise I write experimental reports, Ha ha, suitable for simulation of induction
相关搜索： vhdl 报告

(系统自动生成,下载前可以参看下载内容)

下载文件列表

MyProject/MyProject/138decoder.acf
MyProject/MyProject/138decoder.cnf
MyProject/MyProject/138decoder.fit
MyProject/MyProject/138decoder.gdf
MyProject/MyProject/138decoder.hif
MyProject/MyProject/138decoder.jam
MyProject/MyProject/138decoder.jbc
MyProject/MyProject/138decoder.mmf
MyProject/MyProject/138decoder.ndb
MyProject/MyProject/138decoder.pin
MyProject/MyProject/138decoder.pof
MyProject/MyProject/138decoder.rpt
MyProject/MyProject/138decoder.scf
MyProject/MyProject/138decoder.snf
MyProject/实验报告.doc
MyProject/MyProject
MyProject

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