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文件名称:clock_divider

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [PDF]
  • 上传时间：
    2012-11-16
  • 文件大小：
    22.92kb
  • 已下载：
    0次
  • 提 供 者：
    xi***
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任意小数分频器产生原理，及详细说明文档，任意数分频(包括奇偶数和小数)的设计方法(含VHDL例子)-Generate arbitrary decimal divider principle, and detailed descr iption of the document, arbitrary number of sub-frequency (including the odd-even numbers and decimals) design methods (including VHDL examples)
相关搜索： 分频 frequency divider 小数分频 vhdl 分频 divider frequency divider vhdl odd frequency divider with vhdl 分频器

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任意数分频(包括奇偶数和小数)的设计方法(含VHDL例子).pdf

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