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文件名称:AS_FIFO_DESIGN_Verilog

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2012-11-16
  • 文件大小：
    2.91kb
  • 已下载：
    0次
  • 提 供 者：
    小***
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

使用Verilog硬件描述语言完成了一个异步FIFO的设计，供相关硬件开发人员参考。-Verilog hardware descr iption language used to complete an asynchronous FIFO design, hardware development for the relevant reference.
相关搜索： 异步FIFO Asynchronous FIFO verilog

(系统自动生成,下载前可以参看下载内容)

下载文件列表

第22章 异步FIFO设计/async_cmp.v
第22章 异步FIFO设计/async_fifo.v
第22章 异步FIFO设计/dp_ram.v
第22章 异步FIFO设计/rptr_empty.v
第22章 异步FIFO设计/wptr_full.v
第22章 异步FIFO设计

相关说明

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