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文件名称:SDRAM

  • 所属分类:
  • 标签属性:
  • 上传时间:
    2012-11-16
  • 文件大小:
    2.07mb
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这个是一个基于FPGA的SDRAM控制器系统,实现对SDRAM的读写操作,用来实现时序的控制-This is an FPGA-based SDRAM controller system, the read and write operations to SDRAM to achieve the control of timing
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实战训练13 SDRAM读写控制的实现与Modelsim仿真/doc/micron_sdram.pdf
实战训练13 SDRAM读写控制的实现与Modelsim仿真/doc
实战训练13 SDRAM读写控制的实现与Modelsim仿真/part1/part1_32/model/mt48lc2m32b2.v
实战训练13 SDRAM读写控制的实现与Modelsim仿真/part1/part1_32/model
实战训练13 SDRAM读写控制的实现与Modelsim仿真/part1/part1_32/rtl/Command.v
实战训练13 SDRAM读写控制的实现与Modelsim仿真/part1/part1_32/rtl/control_interface.v
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实战训练13 SDRAM读写控制的实现与Modelsim仿真/part1/part1_32/sim/Command.v
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实战训练13 SDRAM读写控制的实现与Modelsim仿真/part1/part1_32/sim/work/command
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实战训练13 SDRAM读写控制的实现与Modelsim仿真/part1/part1_32/sim/work/control_interface
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实战训练13 SDRAM读写控制的实现与Modelsim仿真/part1/part1_32/sim/work/sdram_test_tb/verilog.asm
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实战训练13 SDRAM读写控制的实现与Modelsim仿真/part1/part1_32/sim/work
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实战训练13 SDRAM读写控制的实现与Modelsim仿真/part1/part2_16/model
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实战训练13 SDRAM读写控制的实现与Modelsim仿真/part1/part2_16/sim/vish_stacktrace.vstf
实战训练13 SDRAM读写控制的实现与Modelsim仿真/part1/part2_16/sim/vsim.wlf
实战训练13 SDRAM读写控制的实现与Mode

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