文件名称:VHDL
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- 上传时间:2012-11-16
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源代码/实验一-分频器设计/clk_div.vhd
源代码/实验一-分频器设计
源代码/实验三-4位可逆计数器和转换器设计/BICOUNTER.vhd
源代码/实验三-4位可逆计数器和转换器设计/GCODE.vhd
源代码/实验三-4位可逆计数器和转换器设计
源代码/实验二-VHDL描述风格比较/MAJ1.vhd
源代码/实验二-VHDL描述风格比较/MAJ2.vhd
源代码/实验二-VHDL描述风格比较/MAJ3.vhd
源代码/实验二-VHDL描述风格比较/MAJ4.vhd
源代码/实验二-VHDL描述风格比较
源代码/实验八-数字密码锁的设计与实现/digilock.vhd
源代码/实验八-数字密码锁的设计与实现
源代码/实验六-序列检测器的设计/fsm.vhd
源代码/实验六-序列检测器的设计
源代码/实验四-7段数码管/segment7.vhd
源代码/实验四-7段数码管/SEGMENTCOUNT.vhd
源代码/实验四-7段数码管
源代码
源代码/实验一-分频器设计
源代码/实验三-4位可逆计数器和转换器设计/BICOUNTER.vhd
源代码/实验三-4位可逆计数器和转换器设计/GCODE.vhd
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源代码/实验二-VHDL描述风格比较/MAJ1.vhd
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源代码/实验二-VHDL描述风格比较/MAJ4.vhd
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源代码/实验八-数字密码锁的设计与实现/digilock.vhd
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源代码/实验六-序列检测器的设计/fsm.vhd
源代码/实验六-序列检测器的设计
源代码/实验四-7段数码管/segment7.vhd
源代码/实验四-7段数码管/SEGMENTCOUNT.vhd
源代码/实验四-7段数码管
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