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文件名称:RISC

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [ASM] [源码]
  • 上传时间：
    2012-11-16
  • 文件大小：
    154.89kb
  • 已下载：
    0次
  • 提 供 者：
    radpr*****
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    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
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失败请重下，重下不扣分。
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介绍说明－－下载内容来自于网络，使用问题请自行百度

source and benchmark test for the registery parts of a RISC processor-source and benchmark test for the registery parts of a RISC　processor
相关搜索： test benchmark RISC VHDL RISC processor VHDL

(系统自动生成,下载前可以参看下载内容)

下载文件列表

lesTestsBench/
lesTestsBench/BR1.bmp
lesTestsBench/Flags.bmp
lesTestsBench/RI.bmp
lesTestsBench/RI2.bmp
lesTestsBench/RI3.bmp
lesTestsBench/RI4.bmp
lesTestsBench/RI5.bmp
lesTestsBench/RI6.bmp
lesTestsBench/RI7.bmp
lesTestsBench/Thumbs.db
work/
work/instr_reg/
work/instr_reg/behave.dat
work/instr_reg/_primary.dat
work/instr_reg_test/
work/instr_reg_test/arch.dat
work/instr_reg_test/_primary.dat
work/ri/
work/ri/behave.dat
work/ri/_primary.dat
work/_info
work/_opt/
work/_opt/work_instr_reg_test_arch.asm
work/_opt/work__info
work/_opt/_deps
work/_opt/__model_tech_.._ieee__info
work/_opt/__model_tech_.._std__info
work/_opt1/
work/_opt1/work_instr_reg_behave.asm
work/_opt1/work__info
work/_opt1/_deps
work/_opt1/__model_tech_.._ieee__info
work/_opt1/__model_tech_.._std__info
work/_temp/
BancRegistre.vhdl
Flag.vhdl
Flag.vhdl.bak
RI.vhdl
RI.vhdl.bak
TestBenchBancRegister.vhdl
TestBenchRegFlag.vhdl
TestBenchRi.vhdl
TestBenchRi.vhdl.bak
transcript
vsim.wlf

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