文件名称:DIVCLK
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所属分类:
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- 上传时间:2012-11-16
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文件大小:72.18kb
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该程序是用VHDL语言实现的时钟分频程序,可以把高频时钟信号分成低频时钟信号,便于实际应用。-The program is the realization of VHDL language program the clock frequency, high frequency clock signal can be divided into low-frequency clock signal, to facilitate the practical application.
(系统自动生成,下载前可以参看下载内容)
下载文件列表
DIVCLK/DIVCLK.sym
DIVCLK/divclk.vhd
DIVCLK/divclkctrl(1).cnf
DIVCLK/divclkctrl(10).cnf
DIVCLK/divclkctrl(11).cnf
DIVCLK/divclkctrl(12).cnf
DIVCLK/divclkctrl(13).cnf
DIVCLK/divclkctrl(14).cnf
DIVCLK/divclkctrl(15).cnf
DIVCLK/divclkctrl(2).cnf
DIVCLK/divclkctrl(3).cnf
DIVCLK/divclkctrl(4).cnf
DIVCLK/divclkctrl(5).cnf
DIVCLK/divclkctrl(9).cnf
DIVCLK/divclkctrl.acf
DIVCLK/divclkctrl.cnf
DIVCLK/divclkctrl.fit
DIVCLK/divclkctrl.gdf
DIVCLK/divclkctrl.hex
DIVCLK/divclkctrl.hif
DIVCLK/divclkctrl.mmf
DIVCLK/divclkctrl.ndb
DIVCLK/divclkctrl.pin
DIVCLK/divclkctrl.pof
DIVCLK/divclkctrl.rpt
DIVCLK/divclkctrl.snf
DIVCLK/divclkctrl.sof
DIVCLK/divclkctrl.ttf
DIVCLK/lcdctrl.acf
DIVCLK/lcdctrl.hif
DIVCLK/lcdctrl.mmf
DIVCLK/LIB.DLS
DIVCLK/U2295292.DLS
DIVCLK/U6457893.DLS
DIVCLK/U8148198.DLS
DIVCLK
DIVCLK/divclk.vhd
DIVCLK/divclkctrl(1).cnf
DIVCLK/divclkctrl(10).cnf
DIVCLK/divclkctrl(11).cnf
DIVCLK/divclkctrl(12).cnf
DIVCLK/divclkctrl(13).cnf
DIVCLK/divclkctrl(14).cnf
DIVCLK/divclkctrl(15).cnf
DIVCLK/divclkctrl(2).cnf
DIVCLK/divclkctrl(3).cnf
DIVCLK/divclkctrl(4).cnf
DIVCLK/divclkctrl(5).cnf
DIVCLK/divclkctrl(9).cnf
DIVCLK/divclkctrl.acf
DIVCLK/divclkctrl.cnf
DIVCLK/divclkctrl.fit
DIVCLK/divclkctrl.gdf
DIVCLK/divclkctrl.hex
DIVCLK/divclkctrl.hif
DIVCLK/divclkctrl.mmf
DIVCLK/divclkctrl.ndb
DIVCLK/divclkctrl.pin
DIVCLK/divclkctrl.pof
DIVCLK/divclkctrl.rpt
DIVCLK/divclkctrl.snf
DIVCLK/divclkctrl.sof
DIVCLK/divclkctrl.ttf
DIVCLK/lcdctrl.acf
DIVCLK/lcdctrl.hif
DIVCLK/lcdctrl.mmf
DIVCLK/LIB.DLS
DIVCLK/U2295292.DLS
DIVCLK/U6457893.DLS
DIVCLK/U8148198.DLS
DIVCLK
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