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文件名称:mainboard_model

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2012-11-16
  • 文件大小：
    7.78kb
  • 已下载：
    0次
  • 提 供 者：
    y***
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

FPGA与dSP的接口，包括testbench部分，以及实现-DSP interface with the FPGA, including part of testbench, as well as the realization of
(系统自动生成,下载前可以参看下载内容)

下载文件列表

r_fifo.v
s_fifo.v
decode.v
decode_tb.v
dsp_port.v
dsp_port_tb.v
encode.v
encode_tb.v
main.v
main.vt
main_tb.v

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