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文件名称:paobiao

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2012-11-16
  • 文件大小：
    288.57kb
  • 已下载：
    0次
  • 提 供 者：
    l****
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一个用verilog编的时钟程序A clock with the procedures for verilog-A clock with verilog program for A clock with the procedures for verilog
相关搜索： paobiao verilog verilog clock

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paobiao/db/paobiao.(0).cnf.cdb
paobiao/db/paobiao.(0).cnf.hdb
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paobiao/db/paobiao.sld_design_entry_dsc.sci
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paobiao/paobiao.qsf
paobiao/paobiao.qws
paobiao/paobiao.sof
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paobiao/paobiao.tan.summary
paobiao/paobiao.v
paobiao/paobiao.v.bak
paobiao/db
paobiao

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