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文件名称:CPU_verilog

  • 所属分类：
    Windows Develop
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2012-11-16
  • 文件大小：
    62.34kb
  • 已下载：
    1次
  • 提 供 者：
    x***
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

一个4级流水线CPU的verilog代码，供参考学习使用，有些语句不能综合，可以通过它学习CPU的工作原理。-A 4-stage pipeline CPU' s verilog code, learning to use for reference, some statements can not be integrated, you can learn from CPU through its works.
相关搜索： verilog CPU pipeline Verilog pipeline PIPELINE VERILOG

(系统自动生成,下载前可以参看下载内容)

下载文件列表

ARM7_vlog/About ARM.txt
ARM7_vlog/accessories.v
ARM7_vlog/addr_reg.v
ARM7_vlog/alu.v
ARM7_vlog/alu_structural.v
ARM7_vlog/and10.dmem
ARM7_vlog/and10.dmemout
ARM7_vlog/and10.dmemr
ARM7_vlog/and10.imem
ARM7_vlog/and10.regout
ARM7_vlog/and10.regsr
ARM7_vlog/arm7.dmem
ARM7_vlog/arm7.dmemout
ARM7_vlog/arm7.dmemr
ARM7_vlog/arm7.imem
ARM7_vlog/arm7.regout
ARM7_vlog/arm7.regsr
ARM7_vlog/arm7.v
ARM7_vlog/arm7_sys.v
ARM7_vlog/armcontroller.v
ARM7_vlog/armdatapath.v
ARM7_vlog/AVLMemory.v
ARM7_vlog/barrel.v
ARM7_vlog/booth.v
ARM7_vlog/clock.v
ARM7_vlog/CPUside.v
ARM7_vlog/defines.v
ARM7_vlog/do_verilog
ARM7_vlog/exception.mem
ARM7_vlog/MemoryInterface.v
ARM7_vlog/Memoryside.v
ARM7_vlog/regfile.v
ARM7_vlog/shift_maker.v
ARM7_vlog/sign_extend.v
ARM7_vlog/SimpleMemory.v
ARM7_vlog/SuperCPSR.v
ARM7_vlog/testbench_addr_reg.v
ARM7_vlog/testbench_alu.v
ARM7_vlog/testbench_arm7.v
ARM7_vlog/testbench_AVLMemory.v
ARM7_vlog/testbench_barrel.v
ARM7_vlog/testbench_booth.v
ARM7_vlog/testbench_controller.v
ARM7_vlog/testbench_CPUside.v
ARM7_vlog/testbench_dedsec.v
ARM7_vlog/testbench_memory.v
ARM7_vlog/testbench_regfile.v
ARM7_vlog/testbench_regfile2.v
ARM7_vlog/testbench_regfile3.v
ARM7_vlog/testbench_regfile4.v
ARM7_vlog/testbench_SimpleMemory.v
ARM7_vlog/testbench_wd_reg.v
ARM7_vlog/test_addr_reg.out
ARM7_vlog/test_alu.out
ARM7_vlog/test_barrel.out
ARM7_vlog/test_booth.out
ARM7_vlog/test_reg.out
ARM7_vlog/test_regfile.out
ARM7_vlog/test_wd_reg.out
ARM7_vlog/wd_reg.v
ARM7_vlog

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