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文件名称:div-8.5

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
  • 上传时间：
    2012-11-16
  • 文件大小：
    236.19kb
  • 已下载：
    0次
  • 提 供 者：
    zh***
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

文件格式：VHDL语言。是自己根据具体需要编写的，并通过时序仿真完全正确。改程序是可以直接解压，然后通过Quartus II打开，编译和仿真。十分方便，好用！-File Format: VHDL language. According to the specific needs of their own prepared, and timing simulation entirely correct. Procedures can be directly diverted to extract, and then open the Quartus II compiler and simulation. Very convenient, easy to use!
(系统自动生成,下载前可以参看下载内容)

下载文件列表

div-8.5/clk_div4.vhd
div-8.5/clk_div4.qpf
div-8.5/clk_div4.qsf
div-8.5/db/wed.wsf
div-8.5/db/clk_div4.db_info
div-8.5/db/prev_cmp_clk_div4.map.qmsg
div-8.5/db/prev_cmp_clk_div4.fit.qmsg
div-8.5/db/clk_div4.map.qmsg
div-8.5/db/prev_cmp_clk_div4.asm.qmsg
div-8.5/db/clk_div4.cbx.xml
div-8.5/db/clk_div4.hif
div-8.5/db/clk_div4.(0).cnf.cdb
div-8.5/db/clk_div4.(0).cnf.hdb
div-8.5/db/clk_div4.hier_info
div-8.5/db/clk_div4.rtlv_sg_swap.cdb
div-8.5/db/clk_div4.map_bb.logdb
div-8.5/db/prev_cmp_clk_div4.tan.qmsg
div-8.5/db/clk_div4.fit.qmsg
div-8.5/db/clk_div4.cmp.logdb
div-8.5/db/clk_div4.sim.qmsg
div-8.5/db/clk_div4.psp
div-8.5/db/clk_div4.dbp
div-8.5/db/clk_div4.pss
div-8.5/db/clk_div4.asm.qmsg
div-8.5/db/clk_div4.sgdiff.hdb
div-8.5/db/clk_div4.tan.qmsg
div-8.5/db/clk_div4.sim.hdb
div-8.5/db/clk_div4.syn_hier_info
div-8.5/db/prev_cmp_clk_div4.sim.qmsg
div-8.5/db/clk_div4.cmp.cdb
div-8.5/db/clk_div4.sim.cvwf
div-8.5/db/clk_div4.sim.rdb
div-8.5/db/clk_div4.map.ecobp
div-8.5/db/clk_div4.pre_map.cdb
div-8.5/db/clk_div4.rtlv.hdb
div-8.5/db/clk_div4.pre_map.hdb
div-8.5/db/clk_div4.rtlv_sg.cdb
div-8.5/db/clk_div4.eco.cdb
div-8.5/db/clk_div4.sgdiff.cdb
div-8.5/db/clk_div4.sld_design_entry_dsc.sci
div-8.5/db/clk_div4.cmp.bpm
div-8.5/db/clk_div4.map_bb.cdb
div-8.5/db/clk_div4.map_bb.hdb
div-8.5/db/clk_div4.map.logdb
div-8.5/db/clk_div4.cmp.ecobp
div-8.5/db/clk_div4.cmp_bb.logdb
div-8.5/db/clk_div4.map.cdb
div-8.5/db/clk_div4.map.hdb
div-8.5/db/clk_div4.map.bpm
div-8.5/db/clk_div4.asm_labs.ddb
div-8.5/db/clk_div4.signalprobe.cdb
div-8.5/db/clk_div4.cmp.tdb
div-8.5/db/clk_div4.cmp_bb.rcf
div-8.5/db/clk_div4.cmp.hdb
div-8.5/db/clk_div4.cmp_bb.cdb
div-8.5/db/clk_div4.cmp_bb.hdb
div-8.5/db/clk_div4.cmp.rdb
div-8.5/db/clk_div4.cmp0.ddb
div-8.5/db/clk_div4.sld_design_entry.sci
div-8.5/db/clk_div4.eds_overflow
div-8.5/clk_div4.fit.rpt
div-8.5/clk_div4.bsf
div-8.5/clk_div4.map.summary
div-8.5/clk_div4.flow.rpt
div-8.5/clk_div4.asm.rpt
div-8.5/clk_div4.pin
div-8.5/clk_div4.fit.smsg
div-8.5/clk_div4.fit.summary
div-8.5/clk_div4.tan.rpt
div-8.5/prev_cmp_clk_div4.qmsg
div-8.5/clk_div4.sof
div-8.5/clk_div4.pof
div-8.5/clk_div4.sim.rpt
div-8.5/clk_div4.vhd.bak
div-8.5/clk_div4.tan.summary
div-8.5/clk_div4.map.rpt
div-8.5/clk_div4.qws
div-8.5/clk_div4.done
div-8.5/clk_div4.vwf
div-8.5/db
div-8.5

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