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文件名称:xapp860

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [PDF]
  • 上传时间：
    2012-11-16
  • 文件大小：
    634.93kb
  • 已下载：
    0次
  • 提 供 者：
    wi***
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

16通道DDR的LVDS接口（VHDL,Verilog and doc）-16-Channel, DDR LVDS Interface with

Real-Time Window Monitoring
相关搜索： Xapp860 LVDS bit_align_machine.vhd

(系统自动生成,下载前可以参看下载内容)

下载文件列表

readme.txt
VERILOG/DDR_6TO1_16CHAN_RT_TX.v
VERILOG/RESOURCE_SHARING_CONTROL.v
VERILOG/BIT_ALIGN_MACHINE.v
VERILOG/RT_WINDOW_MONITOR.v
VERILOG/DDR_6TO1_16CHAN_RT_RX.v
VERILOG/
VHDL/count_to_128.vhd
VHDL/count_to_16x.vhd
VHDL/COUNT_TO_64.vhd
VHDL/seven_bit_reg_w_ce.vhd
VHDL/RESOURCE_SHARING_CONTROL.vhd
VHDL/DDR_6TO1_16CHAN_RT_TX.vhd
VHDL/DDR_6TO1_16CHAN_RT_RX.vhd
VHDL/BIT_ALIGN_MACHINE.vhd
VHDL/RT_WINDOW_MONITOR.vhd
VHDL/
xapp860.pdf

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