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文件名称:dds_v3_test3

  • 所属分类：
    Other systems
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2012-11-16
  • 文件大小：
    14.17mb
  • 已下载：
    1次
  • 提 供 者：
    张***
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

DDS控制器在FPGA上的实现，使用Quartus II8.1开发环境，使用Altera 原理图设计方法，10位宽度，配合dac9-DDS controller in the FPGA on the realization of Quartus II8.1 use development environment, the use of Altera schematic design, 10-bit width, with dac900
相关搜索： DDS DDS vhdl

(系统自动生成,下载前可以参看下载内容)

下载文件列表

dds_v3_test3/.sopc_builder/install.ptf
dds_v3_test3/.sopc_builder/install2.ptf
dds_v3_test3/.sopc_builder/preferences.xml
dds_v3_test3/address_gen.bsf
dds_v3_test3/address_gen.qip
dds_v3_test3/address_gen.v
dds_v3_test3/address_gen_bb.v
dds_v3_test3/address_gen_inst.v
dds_v3_test3/address_gen_wave0.jpg
dds_v3_test3/address_gen_waveforms.html
dds_v3_test3/am_module.bdf
dds_v3_test3/am_module.bsf
dds_v3_test3/bit_cut.bsf
dds_v3_test3/bit_cut.v
dds_v3_test3/bit_cut.v.bak
dds_v3_test3/bit_sel.bsf
dds_v3_test3/bit_sel.v
dds_v3_test3/cpu_0.ocp
dds_v3_test3/cpu_0.sdc
dds_v3_test3/cpu_0.v
dds_v3_test3/cpu_0_ic_tag_ram.mif
dds_v3_test3/cpu_0_jtag_debug_module_sysclk.v
dds_v3_test3/cpu_0_jtag_debug_module_tck.v
dds_v3_test3/cpu_0_jtag_debug_module_wrapper.v
dds_v3_test3/cpu_0_mult_cell.v
dds_v3_test3/cpu_0_ociram_default_contents.mif
dds_v3_test3/cpu_0_oci_test_bench.v
dds_v3_test3/cpu_0_rf_ram_a.mif
dds_v3_test3/cpu_0_rf_ram_b.mif
dds_v3_test3/cpu_0_test_bench.v
dds_v3_test3/DAC900.bsf
dds_v3_test3/DAC_900.v
dds_v3_test3/DAC_900.v.bak
dds_v3_test3/dac_out.bdf
dds_v3_test3/dac_out.bsf
dds_v3_test3/data_sel.bsf
dds_v3_test3/data_sel.v
dds_v3_test3/data_sel.v.bak
dds_v3_test3/db/add_sub_0hj.tdf
dds_v3_test3/db/add_sub_2nj.tdf
dds_v3_test3/db/add_sub_4oj.tdf
dds_v3_test3/db/add_sub_8sj.tdf
dds_v3_test3/db/add_sub_atj.tdf
dds_v3_test3/db/add_sub_fjj.tdf
dds_v3_test3/db/add_sub_hjj.tdf
dds_v3_test3/db/add_sub_hkj.tdf
dds_v3_test3/db/add_sub_ijj.tdf
dds_v3_test3/db/add_sub_jkj.tdf
dds_v3_test3/db/add_sub_kkj.tdf
dds_v3_test3/db/add_sub_ufj.tdf
dds_v3_test3/db/add_sub_vfj.tdf
dds_v3_test3/db/altsyncram_1b71.tdf
dds_v3_test3/db/altsyncram_27p3.tdf
dds_v3_test3/db/altsyncram_3c71.tdf
dds_v3_test3/db/altsyncram_47p3.tdf
dds_v3_test3/db/altsyncram_67p3.tdf
dds_v3_test3/db/altsyncram_9tl1.tdf
dds_v3_test3/db/altsyncram_c572.tdf
dds_v3_test3/db/altsyncram_d5g1.tdf
dds_v3_test3/db/altsyncram_e502.tdf
dds_v3_test3/db/altsyncram_egq1.tdf
dds_v3_test3/db/altsyncram_f5g1.tdf
dds_v3_test3/db/altsyncram_ggq1.tdf
dds_v3_test3/db/altsyncram_hg41.tdf
dds_v3_test3/db/altsyncram_igq1.tdf
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dds_v3_test3/db/altsyncram_jrf1.tdf
dds_v3_test3/db/altsyncram_qed1.tdf
dds_v3_test3/db/a_dpfifo_8t21.tdf
dds_v3_test3/db/a_fefifo_7cf.tdf
dds_v3_test3/db/cmpr_5cc.tdf
dds_v3_test3/db/cmpr_8cc.tdf
dds_v3_test3/db/cmpr_9cc.tdf
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dds_v3_test3/db/cntr_gui.tdf
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dds_v3_test3/db/cntr_obi.tdf
dds_v3_test3/db/cntr_pbi.tdf
dds_v3_test3/db/cntr_rj7.tdf
dds_v3_test3/db/cntr_sbi.tdf
dds_v3_test3/db/cntr_u4j.tdf
dds_v3_test3/db/decode_rqf.tdf
dds_v3_test3/db/ded_mult_2o81.tdf
dds_v3_test3/db/dffpipe_93c.tdf
dds_v3_test3/db/dpram_5h21.tdf
dds_v3_test3/db/lpm_add_sub2_add_sub.v
dds_v3_test3/db/lpm_constant_6e6.tdf
dds_v3_test3/db/lpm_constant_7e6.tdf
dds_v3_test3/db/lpm_constant_ek6.tdf
dds_v3_test3/db/lpm_constant_vl6.tdf
dds_v3_test3/db/mult_add_4cr2.tdf
dds_v3_test3/db/mult_add_6cr2.tdf
dds_v3_test3/db/mult_c1p.tdf
dds_v3_test3/db/mult_e2p.tdf
dds_v3_test3/db/mult_k1p.tdf
dds_v3_test3/db/mult_m2p.tdf
dds_v3_test3/db/mux_9oc.tdf
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dds_v3_test3/db/prev_cmp_sine_DDS.map.qmsg
dds_v3_test3/db/prev_cmp_sine_DDS.qmsg
dds_v3_test3/db/prev_cmp_sine_DDS.tan.qmsg
dds_v3_test3/db/scfifo_1n21.tdf
dds_v3_test3/db/sine_DDS.(0).cnf.cdb
dds_v3_test3/db/sine_DDS.(0).cnf.hdb
dds_v3_test3/db/sine_DDS.(1).cnf.cdb
dds_v3_test3/db/sine_DDS.(1).cnf.hdb
dds_v3_test3/db/sine_DDS.(10).cnf.cdb
dds_v3_test3/db/sine_DDS.(10).cnf.hdb
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dds_v3_test3/db/sine_DD

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