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文件名称:yiweiDCTbianhuan

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [ASM] [源码]
  • 上传时间：
    2012-11-16
  • 文件大小：
    411.97kb
  • 已下载：
    0次
  • 提 供 者：
    匡***
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

一维DCT变换的Verilog HDL源程序，在ISE中已经通过编译，可以参考里面的文档。-One-dimensional DCT transform Verilog HDL source code, in the ISE has been through the compilation, you can refer to inside the document.
相关搜索： ISE Verilog

(系统自动生成,下载前可以参看下载内容)

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yiweiDCTbianhuan/实战训练21 整数DCT变换的设计与实现/1ddct/.untf
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yiweiDCTbianhuan/实战训练21 整数DCT变换的设计与实现/1ddct/__projnav/dct.xst
yiweiDCTbianhuan/实战训练21 整数DCT变换的设计与实现/1ddct/__projnav/dct_test.xst
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yiweiDCTbianhuan/实战训练21 整数DCT变换的设计与实现/rtl/d1_dct.v
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yiweiDCTbianhuan/实

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