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文件名称:trigger

  • 所属分类：
    VHDL-FPGA-Verilog
  • 标签属性：
    [VHDL] [源码]
  • 上传时间：
    2012-11-16
  • 文件大小：
    4.79kb
  • 已下载：
    0次
  • 提 供 者：
    孙***
  • 相关连接：
    无
  • 下载说明：
    别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容来自于网络，使用问题请自行百度

D触发器和JK触发器，使用emacs编写源文件，iverilog仿真通过，内有png仿真图像截屏-D flip-flop and JK flip-flop, use emacs to prepare source file, iverilog simulation adopted, within the simulation images png screenshots
相关搜索： JK trigger

(系统自动生成,下载前可以参看下载内容)

下载文件列表

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trigger/jk_trigger.v
trigger/jk_trigger.vcd
trigger/jk_trigger.v~
trigger/d_trigger.v
trigger/d_trigger.vcd
trigger/jk_trigger.vvp
trigger/d_trigger.v~
trigger/d_trigger.vvp

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