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搜索资源列表

  1. random-binary

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  2. 数字调制器的墓本构建模块是函数random-binary,它产生电平值为+1或一1的二进制波形,产生的比特数以及每比 特的采样数是该函数的参数。函数random-binary可以仿真多个数字调制器,例如,可用如下MATLAB语句仿真一个QPSK调制器: 下列MATLAB程序产生一个长10比特的QPSK信号,采样频率为每比特8个采样点: -Digital modulator building blocks of the tomb is a function of the random
  3. 所属分类:source in ebook

    • 发布日期:2017-03-23
    • 文件大小:244046
    • 提供者:defang
  1. SignalGenerator

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  2. 该波形发生器以MAX038函数发生器为核心,采用数字、模拟结合的方法,产生正弦波、三角波和方波信号,频率范围可达10Hz~1MHz,并能进行七个频率段的选择,后级采用集成运放来提高输出波形质量并增强带负载能力,最终得到所要求的输出波形,较好的满足大多数实验与检测的需求。-The waveform generator to MAX038 function generator as the core, using digital, analog method of combining to prod
  3. 所属分类:SCM

    • 发布日期:2017-03-28
    • 文件大小:45622
    • 提供者:simon
  1. Producers

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  2. (1)操作系统中允许同时有多个进程并发进行,进程对共享资源存在互斥或者协作关系。其中生产者进程产生信息资源,可以是计算进程。消费者进程使用信息,它可以是输出打印进程,对于缓冲区生产者与消费者进程互斥使用,其次,消费者进程依赖于生产者产生的资源,如果尚未得到满足,则必须等待生产者信号的唤醒; (2)本程序运行必须设置模拟系统缓冲区的个数以及系统进程的个数,对于每个程序,还必须设置其属性,即是生产者或者消费者,由简单的数字1和2表示。对于缓冲区的设置和进程个数及属性的设置可以根据需要模拟互斥和贡
  3. 所属分类:CSharp

    • 发布日期:2017-03-30
    • 文件大小:1970
    • 提供者:youyu
  1. ProcessSynchronizationAndMutualExclusion

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  2. (1)操作系统中允许同时有多个进程并发进行,进程对共享资源存在互斥或者协作关系。其中生产者进程产生信息资源,可以是计算进程。消费者进程使用信息,它可以是输出打印进程,对于缓冲区生产者与消费者进程互斥使用,其次,消费者进程依赖于生产者产生的资源,如果尚未得到满足,则必须等待生产者信号的唤醒; (2)本程序运行必须设置模拟系统缓冲区的个数以及系统进程的个数,对于每个程序,还必须设置其属性,即是生产者或者消费者,由简单的数字1和2表示。对于缓冲区的设置和进程个数及属性的设置可以根据需要模拟互斥和贡
  3. 所属分类:CSharp

    • 发布日期:2017-04-25
    • 文件大小:97159
    • 提供者:youyu
  1. CH451DS1

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  2. 很详细AD7705是应用于低频测量的2通道的模拟前端。该器件可以接受直接来自传感器的低电平的输入信号,然后产生串行的数字输出。 -very good
  3. 所属分类:Embeded-SCM Develop

    • 发布日期:2017-03-30
    • 文件大小:233455
    • 提供者:冷冰
  1. jishi

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  2. 本项目设计采用了6位数码管显示电路,在设计6位LED显示时,为了简化电路,降低成本,采用动态显示的方式,6个LED显示器共用一个8位的I/O,6位LED数码管的位选线分别由相应的P2.0--P2.5控制,而将其相应的段选线并联在一起,由一个8位的I/O口控制,即P0。译码显示电路将“时”,“分”,“秒”计数器的输出状态经显示译码器译码,通过6位LED七段显示器显示出来。达到定时电路时根据计时系统的输出状态产生的一个脉冲信号,然后去触发蜂鸣器发生器来实现闹铃。校时电路是用来对“时”,“分”,“秒”
  3. 所属分类:SCM

    • 发布日期:2017-03-25
    • 文件大小:21353
    • 提供者:David
  1. 20070823003

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  2. 自动识别系统电台的卞要功能是在接收状态将接收到的射频信号解调成高斯最小频移键控(GMSI})比特流以供信号处理板使用 而在发射状态则将来自处理板的9.6 kbps的GMSI}比特流调制成适合发射的射频信号并发射。木电台使用半双工方式工作,共用一副大线,其中发射通路只有一个通道,但可通过微处理器改变调制芯片LMX1501的内部设置数以产生两个频率,然后再经过卜变频得到中心频率分别为162.025 MHz和161.975 MHz的发射信号 木电台的接收则分为二路,其解调芯片都是用TA31136来实
  3. 所属分类:Communication

    • 发布日期:2017-04-01
    • 文件大小:11827
    • 提供者:王军
  1. tuxang

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  2. 数字图像高斯噪声的去除方法的研究和产生高斯的小信号下的可能-Digital image Gaussian noise removal methods of research and produce the small-signal under the Gaussian potential
  3. 所属分类:Graph program

    • 发布日期:2017-04-01
    • 文件大小:219752
    • 提供者:李树龙
  1. jiyumohushenjingwangluo

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  2. 基于模糊神经网络盲均衡算法的研究 摘要 无线和数字通信系统中,由于信号在传输过程中会受到复杂传播机制 的影响,从而产生码间干扰。为了消除码间干扰,要在接收端进行均衡, 以补偿信道特性,正确恢复发送序列。传统的均衡器由于需要不断地发送 训练序列,已经不能满足数字通信技术发展的要求。盲均衡技术不需要训 练序列,仅利用接收序列的统计特性便能自适应地调节参数,也就是说, 盲均衡技术本身完全不用训练序列,就可以自启动收敛并防止失锁情况, 且能使滤波器的输出与要恢复的输入信号
  3. 所属分类:AI-NN-PR

    • 发布日期:2017-05-24
    • 文件大小:7982676
    • 提供者:钟情
  1. work

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  2. 此程序通过采样产生了一个非常标准的BPSK信号,是理解通信原理数字调制的好帮手-his procedure generated by sampling a very standard BPSK signal, digital modulation is to understand the principles of good communication assistant
  3. 所属分类:matlab例程

    • 发布日期:2013-08-02
    • 文件大小:857
    • 提供者:liuyang
  1. freq

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  2. 应用VHDL语言设计低频数字频率计,选择测频法方案,主要是控制电路,由其产生闸门、清零和锁存等信号。-VHDL, design low frequency digital frequency meter, select the frequency method to program, mainly the control circuit, produced by the gate and the latch so clear signal.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:438971
    • 提供者:付晓
  1. shuzixinhao

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  2. 本信号发生器依据直接数字频率合成原理合成信号,采用自行设计复杂可 编程逻辑器件的方案实现频率合成,扩展数据存储器存储波形的量化幅值(波形数 据),在单片机的控制与协调下输出频率和相位可调的信号波形.该信号发生器可产生 任意波形,成本低、体积小、使用方便.-The signal generator based on principles of direct digital frequency synthesis synthesized signal, using complex pro
  3. 所属分类:Project Design

    • 发布日期:2017-03-31
    • 文件大小:385841
    • 提供者:姚木
  1. ask

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  2. 自己编程产生一种二进制调制信号,为数字调制信号的识别做准备。-Their programming to produce a binary modulation signal, the recognition of digital modulation signals in preparation.
  3. 所属分类:AI-NN-PR

    • 发布日期:2017-04-10
    • 文件大小:678
    • 提供者:wuweiwei
  1. psk

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  2. 自己编程产生一种二进制频率调制信号,为数字调制信号的识别做准备。- programming to produce a binary frequency modulation signal, the recognition of digital modulation signals in preparation.
  3. 所属分类:AI-NN-PR

    • 发布日期:2017-04-05
    • 文件大小:702
    • 提供者:wuweiwei
  1. fsk

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  2. 自己编程产生一种二进制频率调制信号,为数字调制信号的识别做准备。- programming to produce a binary frequency modulation signal, the recognition of digital modulation signals in preparation.
  3. 所属分类:AI-NN-PR

    • 发布日期:2017-04-11
    • 文件大小:749
    • 提供者:wuweiwei
  1. 4psk

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  2. 自己编程产生一种四进制相位调制信号,为数字调制信号的识别做准备。-programming to produce a quaternary phase modulation signal, the recognition of digital modulation signals in preparation.
  3. 所属分类:AI-NN-PR

    • 发布日期:2017-04-11
    • 文件大小:874
    • 提供者:wuweiwei
  1. DTMF5410

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  2. DTMF 编解码器在编码时将击键或数字信息转换成双音信号并发送,解码时在收到的DTMF 信号中检测击键或数字信息的存在性.采用ccs2.2开发。运行在DES5410APP-U开发版上。 子程序_start_ac01,完成AD 及DSP 的多通道缓冲串口(McBSP)初始化。 子程序_iir_to_dtmf,通过由函数set_freq_coff()初始化的系数,分别迭代运算产生行 频和列频,该子程序计算出的两个频率信号样本值分别放入累加器a 和b,相加之 后作为新的一个音频样本发送
  3. 所属分类:Voice Compress

    • 发布日期:2017-03-30
    • 文件大小:38430
    • 提供者:黄天
  1. beipinqilunwen

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  2. 用微型计算机控制锁相环(PLL)可对计量光栅信号进行数字倍频 用这种挂 术产生的角度定标脉冲去量度齿轮侍动链误差比用时钟脉冲夸理,布助于蓰壹考粤 仪器的动态检测精度.-Phase-locked loop with a micro-computer control (PLL) can be grating on the measurement of digital harmonic signal generated with this hanging point calibration t
  3. 所属分类:matlab

    • 发布日期:2017-03-28
    • 文件大小:119441
    • 提供者:owen
  1. imageprocessing_use_mid_filter

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  2. 利用中值滤波进行数字图像处理,B从人眼的结构和视觉特性出发I研究了图像中噪声产生的机理和消除的方法L提出了利用 中值滤波法消除图像噪声的实用方法I对影响图像信号的不同噪声采用了不同的滤波方法I并对信号的频谱和滤波的效果进行了研究和分析M利用中值滤波法消除图像中的随机噪声是图像噪声处理的最佳方法-Median filtering using digital image processing, B from the structure of the human eye and visual ch
  3. 所属分类:Special Effects

    • 发布日期:2017-04-04
    • 文件大小:121784
    • 提供者:k
  1. 2345676588FPGAxiebofenxi

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  2. 本文给出一种基于FPGA的新型谐波检测系统的设计方案。在该方案中,采用FPGA实现快速的FFT运算,采用数字锁相环来同步被测信号,以减小由非同步采样所产生的误差并给出实现的设计实现。数字锁相环和FFT算法用VHDL语言设计实现,该方案能提高谐波分析的精度以及响应速度,同时大大地精简了硬件电路, 系统升级非常方便。-This paper presents a new FPGA-based harmonic detection system design. In the scheme, using
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-17
    • 文件大小:18179
    • 提供者:何正亚
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