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搜索资源列表

  1. da_filter

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  2. DA,分布式算法的FILTER滤波器的设计,verilog设计与实现-DA, distributed algorithm of FILTER FILTER design, verilog design and implementation
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:2227
    • 提供者:洪依
  1. Design-and-test-verilog-hdl

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  2. 《设计与验证Verilog HDL》的随书光盘-Design and test Verilog HDL of CD attached with books
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-10
    • 文件大小:2493019
    • 提供者:胡飞飞
  1. verilog

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  2. 题目在压缩包中,如:设计4 位超前进位加法器。并给出测试模块和测试分析结 果。 -topic in the packet
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:458584
    • 提供者:宝路
  1. LED-and-LCD-verilog-hdl

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  2. 基于fpga开发电子时钟,显示用到led和lcd,总体设计思路-FPGA realization of research on the LCD display driver s control
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-26
    • 文件大小:253771
    • 提供者:po
  1. SecondDelay

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  2. verilog源代码。 秒倒计时Verilog设计(倒计时秒数可设置),可根据系统时钟更改参数。 -verilog source code,to implement the second counter, with the second number as a parameter.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-13
    • 文件大小:2098
    • 提供者:李海华
  1. verilog-hdl

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  2. verilog hdl quartues-硬件描述语言, 数字系统设计,设计数字系统,灵活方便,更改方便,设计流程时间段
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:5296
    • 提供者:陈晨
  1. Verilog-135-classic-example

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  2. Verilog的135个经典设计实例.方便实用!-Verilog 135 classic example of design is convenient and practical!
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:113901
    • 提供者:李联斗
  1. spacewire_src

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  2. opencores上的关于spacewire的初级源码,已经通过板上实验,但是工程应用有待完善,可以作为设计人员的设计参考-opencores on spacewire on the primary source, the board has passed the test, but the engineering applications need to be improved, can be used as design The design reference staff
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-14
    • 文件大小:3251872
    • 提供者:
  1. xiawenyu-verilog-

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  2. 数字系统设计的入门书,教你如何学会用verilog语言实现各种数字逻辑功能,例程经典易懂-xiawenyu verilog
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-12
    • 文件大小:3017115
    • 提供者:马婷婷
  1. Verilog-HDL

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  2. Verilog HDL 程序设计例程-Verilog HDL program design routines
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:114505
    • 提供者:123
  1. Verilog-HDL

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  2. 《Verilog HDL数字控制系统设计实例》书中的源代码。-source code of the book "Verilog HDL digital control system design example".
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-29
    • 文件大小:11925015
    • 提供者:zw
  1. Verilog--classic

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  2. verilog 的经典教程,包含基本命令定义等内容并且由实例讲解了具体的编程方法和设计思想-Verilog classic tutorials, include basic commands the content such as defined by example and explain the specific programming method and design thought
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-04
    • 文件大小:1327032
    • 提供者:dst
  1. iicbus

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  2. fpga nios iic gprs verilog 设计-fpga nios iic gprs verilog
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-08
    • 文件大小:1909730
    • 提供者:zyc
  1. Verilog

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  2. verilog基本电路设计指导书 作为初学者很有用-Verilog basic circuit design procedure
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:363206
    • 提供者:zhangpeixu
  1. verilog-course-design

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  2. 两个关于Verilog语言学习的课程设计,有要求、思路和代码,一个是芯片接口设计,一个是智能烧烤机设计-Two on the Verilog language learning course design, requirements, ideas and code, a chip interface design, a smart barbecue machine design
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:677028
    • 提供者:张驰
  1. Verilog

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  2. 基于verilog的设计,本册设计是全自动洗衣机的设计,有六种不同的功能-Based on the design of vhgdl, this book design is the design of the automatic washing machine, there are six different functions
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:306195
    • 提供者:xiaoqiangqq
  1. Verilog-HDL

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  2. Verilog HDL设计+Modelsim仿真UART-Verilog HDL Designing+ Modelsim UART simulation
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:23972
    • 提供者:WangQunfeng
  1. Verilog

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  2. 无线通信FPGA设计的VHDL编程,里面的内容很详细-wire communication VHDL program
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:143250
    • 提供者:吴亚华
  1. MP3-design-using-verilog

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  2. 基于Xilinx XUPV2P平台(FPGA开发板)的MP3播放器设计-MP3 player design based on the the Xilinx XUPV2P platform (FPGA development board)
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-10
    • 文件大小:1731485
    • 提供者:zhxuqin
  1. DDS-design-based-on-verilog

    0下载:
  2. 用verilog语言设计DDS数字频率合成器-DDS design based on verilog
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-09
    • 文件大小:1049501
    • 提供者:zhxuqin
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