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搜索资源列表

  1. c51

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  2. 51数字钟带各种扩展年,月,日等并且可预置。用汇编语言写的-51 digital clock with extended assembly language
  3. 所属分类:Other Embeded program

    • 发布日期:2017-11-22
    • 文件大小:566
    • 提供者:张了
  1. shuzizhong

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  2. 基于STC12C5A60S2设计的数字钟,已经实现!-STC12C5A60S2 design based on the digital clock, has come true!
  3. 所属分类:SCM

    • 发布日期:2017-11-13
    • 文件大小:158128
    • 提供者:chenjiuyi
  1. digital-clock

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  2. CPLD Verilog HDL实现数字钟-CPLD Verilog HDL digital clock
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-11
    • 文件大小:95667
    • 提供者:高飞
  1. m60

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  2. 数字钟(for DE2 开发板) 1.‘时’、‘分’、‘秒’的十进制数字显示(小时从00~23)计时器。 2. 手动校时、校分、校秒的功能。 3.定时与闹钟功能,能在设定的时间发出闹铃声。 4.进行整点报时。从59分50秒起,每隔2秒钟发出一次低音“嘟”的信号,连续5次,最后一次发出高音“嘀”的信号,此信号结束即达到整点。 5、一个秒表,最低位1 秒、60秒,手动停止,手动重置。 6、一个倒计时,显示小时、分钟、秒,可设置时间。 -Decimal digital
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-29
    • 文件大小:907955
    • 提供者:dai
  1. ep1c12_15_clock

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  2. 数字钟设计:该程序完成了在Quartus Ⅱ上使用VHDL语言实现的24小时数字钟设计-Digital clock design: the process is complete Quartus Ⅱ a digital clock using VHDL language design
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-27
    • 文件大小:72859
    • 提供者:无敌县令
  1. duogongnengzhong

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  2. 多功数字钟 时间可调,校准时间,年月日,闹钟-Adjustable multi-functional digital clock time, calibration time, date, alarm clock
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-15
    • 文件大小:608851
    • 提供者:fyhsam
  1. zhangxing

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  2. 利用vhdl语言设计的数字钟,能进行正常的时、分、秒计时功能,分别由6个数码管显示24h、60min、60s-Digital alarm clock, clock and alarm functions
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-28
    • 文件大小:491974
    • 提供者:张迪
  1. dianzizhong

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  2. 单片机数字钟,实现电子钟的一些基本功能。-Microcontroller digital clock, and some of the basic functions of the electronic clock.
  3. 所属分类:SCM

    • 发布日期:2017-12-01
    • 文件大小:3020
    • 提供者:shizhen
  1. duogongnengshuzizhong

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  2. 多功能数字钟VHDL源文件,采用动态显示方式,6个数码管-Multifunction digital clock VHDL source files, dynamic display, six digital tube
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-11
    • 文件大小:1368
    • 提供者:叶叶
  1. clock

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  2. 基于C8051F310单片机的数字钟显示系统,实现精确显示年月日,时分的功能。-C8051F310 microcontroller based digital clock display system to achieve accurate display of the date, time division function.
  3. 所属分类:SCM

    • 发布日期:2017-12-01
    • 文件大小:10967
    • 提供者:liuhao
  1. shizhongfinal

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  2. 通过按键控制的数字钟,verilog代码-a diagil clock design by verilog
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-10
    • 文件大小:805978
    • 提供者:mike
  1. shuzizhong

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  2. 在单片机上实现数字钟,时分秒的显示以及整点报时功能。-Realize single-chip digital clock, hour, minute and second of the display, as well as the whole point timekeeping function.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-10
    • 文件大小:7687
    • 提供者:王军
  1. duogongnengshuzizhong

    0下载:
  2. 多功能数字钟,方法便好用,适用于新手,希望大家喜欢-Multifunction digital clock, the method will be easy to use, suitable for novice, hope you like
  3. 所属分类:SCM

    • 发布日期:2017-12-10
    • 文件大小:1756784
    • 提供者:lili
  1. Chip-digital-clock

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  2. 基于51单片机数字钟程序设计,希望对大家有用。-Digital clock program based on 51 single-chip design, and hope to be useful.
  3. 所属分类:assembly language

    • 发布日期:2017-11-16
    • 文件大小:16873
    • 提供者:丁哥
  1. hour

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  2. 基于89C52单片机的数字钟系统,C语言-Based on the 89C52 microcontroller digital clock system, C language
  3. 所属分类:Other systems

    • 发布日期:2017-11-16
    • 文件大小:26079
    • 提供者:李志伟
  1. shuzizhong

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  2. 该程序可在52单片机实现数字钟,三个按键可分别调制时、分、秒-The program in 52 single-chip digital clock, three keys can be separately modulated hours, minutes, seconds
  3. 所属分类:Other systems

    • 发布日期:2017-11-25
    • 文件大小:4714
    • 提供者:胖猴
  1. clock1

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  2. 基于FPGA的数字钟设计代码,可显示时间,报时,调时,在开发板EP3C16Q240C8上可实现。-FPGA-based digital clock design code, time, timekeeping, tune in development board EP3C16Q240C8, to achieve.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-27
    • 文件大小:1813381
    • 提供者:裴蕾
  1. lab14

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  2. DE2平台上实现的数字钟,包含时、分、秒的24小时制时间系统,有校时,准点报时,整点广播等功能。-DE2 platform digital clock, contains, minutes, seconds, 24-hour time system, school, prospective point of time, the whole point of broadcasting.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-16
    • 文件大小:1137925
    • 提供者:DYQ
  1. clock

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  2. 多功能数字钟:正常显示时分秒,设置调整时间,秒表,闹钟-Multifunctional digital clock: normal display, minutes and seconds, set to adjust the time, stopwatch, alarm clock
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-27
    • 文件大小:6655
    • 提供者:Atera
  1. CPLD-digital-clock-design

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  2. 基于CPLD实验板的多功能数字钟设计,运用VHDL编写程序-Multifunction digital clock design based on CPLD experimental board, the use of VHDL programming
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-11-03
    • 文件大小:73302
    • 提供者:木子李
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