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  1. dotnet写的文件分割器

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  2. 下面我将这个文件分割器的运行流程简单列出如下: 1、 选择要分割原文件,用OpenFileDialog控件实现,变量SplitSourceFileName 记录文件路径。 2、 选择分割后文件的保存地址,用FolderBrouserDialog控件实现,变量SplTargetFolder记录保存路径。 3、 用户输入分块大小,可选择以KB或以MB为单位,变量ItemSize记录。 4、 点击“开始分割”按键,若个参数合法,则开始执行分割过程,进度条显示执行进度,否则提示错误。
  3. 所属分类:文件操作

    • 发布日期:2008-10-13
    • 文件大小:28.79kb
    • 提供者:soft271
  1. VHDL范例

    1下载:
  2. 最高优先级编码器 8位相等比较器 三人表决器(三种不同的描述方式) 加法器描述 8位总线收发器:74245 (注2) 地址译码(for m68008) 多路选择器(使用select语句) LED七段译码 多路选择器(使用if-else语句) 双2-4译码器:74139 多路选择器(使用when-else语句) 二进制到BCD码转换 多路选择器 (使用case语句) 二进制到格雷码转换 双向总线(注2) 汉明纠错吗译码器 三态总线(注2) 汉明纠错吗
  3. 所属分类:单片机(51,AVR,MSP430等)

    • 发布日期:2008-10-13
    • 文件大小:41.88kb
    • 提供者:kerty
  1. codeofvhdl2006

    1下载:
  2. 【经典设计】VHDL源代码下载~~ 其中经典的设计有:【自动售货机】、【电子钟】、【红绿灯交通信号系统】、【步进电机定位控制系统】、【直流电机速度控制系统】、【计算器】、【点阵列LED显示控制系统】 基本数字逻辑设计有:【锁存器】、【多路选择器】、【三态门】、【双向输入|输出端口】、【内部(缓冲)信号】、【编码转换】、【加法器】、【编码器/译码器】、【4位乘法器】、【只读存储器】、【RSFF触发器】、【DFF触发器】、【JKFF触发器】、【计数器】、【分频器】、【寄存器】、【状态机】
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:43.15kb
    • 提供者:senkong
  1. latch

    0下载:
  2. 门拴电路,4位选择器,alu,用verilog写的。-doors Shuan circuit, four selectors, ALU, with Verilog writes.
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:1.34kb
    • 提供者:杨艳
  1. ZZCPLD

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  2. 本文详细介绍了制作电路板的方法及步骤. 实验板的功能 这个实验板可以做如下实验: 1.可以进行运算器(加、减、乘和除法)、比较器、译码器、编码器、选择器、分配器和一般组合电路的实验 2.可以进行触发器、寄存器、计数器和一般时序电路的实验 3.可以进行频率计电路、时钟电路、计时电路、交通灯等复杂数字系统的实验 4.加扩展板可以进行A/D、D/A、串行E2ROM和8031单片机等方面的实验 -This paper describes a circuit board pro
  3. 所属分类:单片机(51,AVR,MSP430等)

    • 发布日期:2008-10-13
    • 文件大小:415.49kb
    • 提供者:cheng
  1. C_9

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  2. 100个经典vhdl编程实例, 第1例 带控制端口的加法器 第2例 无控制端口的加法器 第3例 乘法器 第4例 比较器 第5例 二路选择器 第6例 寄存器 第7例 移位寄存器 第8例 综合单元库 第9例 七值逻辑与基本数据类型 第10例 函数 第11例 七值逻辑线或分辨函数 第12例 转换函数 第13例 左移函数 第14例 七值逻辑程序包 第15例 四输入多路器...... -100 vhdl classical programmi
  3. 所属分类:书籍源码

    • 发布日期:2008-10-13
    • 文件大小:329.5kb
    • 提供者:袁虎
  1. VERILOGSELE

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  2. 运用always 块设计一个八路数据选择器。要求:每路输入数据与输出数据均为4 位2进制数,当选择开关(至少3 位)或输入数据发生变化时,输出数据也相应地变-always use a block design options for the Eighth Route Army data. Requirements : every road input data and output data are four two-band number, When choosing to switch (a
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:14.59kb
    • 提供者:周正华
  1. sdgshjd

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  2. 数字系统设计这是有关的相关源代码,有简易CPU 除法器、计数器等 ...[fpdiv_vhdl.rar] - 四位除法器的vhdl源程序 [vhdl范例.rar] - 最高优先级编码器8位相等比较器 三人表决器(三种不同的描述方式) 加法器描述 8位总线收发器:74245 (注2) 地址译码(for m68008) 多路选择器(使 BR> ... -Digital System Design This is the underlying source code, a simple C
  3. 所属分类:并行运算

    • 发布日期:2008-10-13
    • 文件大小:838byte
    • 提供者:张瑞
  1. 4选1选择器

    0下载:
  2. 基于matlab的4选1选择器,能正常运行。
  3. 所属分类:源码下载

    • 发布日期:2010-10-07
    • 文件大小:2.91kb
    • 提供者:chzhang_auts
  1. 4选1选择器

    0下载:
  2. 基于matlab的4选1选择器,已通过运行。
  3. 所属分类:源码下载

    • 发布日期:2010-10-07
    • 文件大小:2.91kb
    • 提供者:chzhang_auts
  1. 多路选择器

    0下载:
  2. 由3-mux和4-mux组成12-mux的verilog编码
  3. 所属分类:VHDL编程

    • 发布日期:2011-12-05
    • 文件大小:784byte
    • 提供者:shengzhe0
  1. 100vhdl_example

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  2. vhdl语言的100个例子 VHDL语言100例 第1例 带控制端口的加法器 第2例 无控制端口的加法器 第3例 乘法器 第4例 比较器 第5例 二路选择器 第6例 寄存器 第7例 移位寄存器 第8例 综合单元库 第9例 七值逻辑与基本数据类型 第10例 函数 -VHDL language, VHDL language 100 examples of 100 cases of the first one cases of the control p
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:218.35kb
    • 提供者:光明顶
  1. VHDL100

    0下载:
  2. VHDL语言100例 第1例 带控制端口的加法器 第2例 无控制端口的加法器 第3例 乘法器 第4例 比较器 第5例 二路选择器 第6例 寄存器 第7例 移位寄存器 第8例 综合单元库 第9例 七值逻辑与基本数据类型 第10例 函数-VHDL
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:299.96kb
    • 提供者:lsp
  1. 4_1

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  2. 4 选1 多路选择器-4 to 1 MUX ========
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:167.64kb
    • 提供者:彭红
  1. 4

    0下载:
  2. 双四选一数据选择器74LS153,1、写一个程序,用顺序描述语句和并发描述语句(选择信号代入语句或者条件信号代入语句)分别控制74LS153的一个输出端Q。 2、比较一下顺序语句与并行语句各自的优缺点。 输入:逻辑开关。输出:LED灯。 -A double four election data selector 74LS153, 1, write a program, with sequential and concurrent statements describe the sta
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:2.21kb
    • 提供者:李小勇
  1. 4-to-1

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  2. 4选1数据选择器,有使能端控制,4个数据输入,2个地址端,1个输出-4 1 data selector, enable end control, four data inputs, two addresses end, an output
  3. 所属分类:Other systems

    • 发布日期:2017-11-24
    • 文件大小:18.09kb
    • 提供者:J
  1. 4-to-1-digital-selector

    0下载:
  2. 4选1数字选择器的Verilog硬件语言实现,开发环境是ModelSim-4 to 1 digital selector Verilog hardware language development environment ModelSim
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-12-06
    • 文件大小:3.21kb
    • 提供者:klxl
  1. jscolor-1.4.0

    0下载:
  2. 简单,易于使用的颜色选择器Javascr ipt控件。它拥有HSV和HVS两种模式,可以设置一个默认展示颜色在初化加载的时候。返回十六进制值。-Simple, easy to use color picker Javascr ipt control. HSV and HVS It has two modes, you can set a default display color at the beginning of the load time. Back hexadecimal value.
  3. 所属分类:Other systems

    • 发布日期:2017-04-03
    • 文件大小:13.73kb
    • 提供者:jack
  1. mux41

    0下载:
  2. 四选一数据选择器(四个输入选择一个输出)(Four select a data selector)
  3. 所属分类:VHDL/FPGA/Verilog

    • 发布日期:2017-12-19
    • 文件大小:293kb
    • 提供者:木七渊
  1. 传奇登陆器9

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  2. 1.解压以后请将此登陆器放在传奇客户端里,既可以玩游戏了。 2.启动登陆器以后,点添加游戏,写上自己的游戏名字和IP,点添加,点保存即可. 3.如果登陆器被报毒。是因为破解的原因,请选择信任,这样就可以。 4.如果点击登陆器无如何反应,请关闭所有杀毒软件。(Please send this 1. after decompression on the landers legend client, can play the game. 2. start after adding
  3. 所属分类:*编程

    • 发布日期:2017-12-16
    • 文件大小:2.56mb
    • 提供者:pfjuifv
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