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搜索资源列表

  1. hw3

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  2. Write VHDL codes to model an 8-bit counter that counts every second. It counts from your last two digits of your student ID to your next two digits of your student ID. If the last two digits are greater than the next two digits, the counters counts d
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:352708
    • 提供者:vinay
  1. hw4

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  2. Write VHDL codes to show, on two 7-segment LEDs, the binary coded decimal (BCD) equivalence of the binary representation of the state of eight switches. Use a function to perform the specified task. Assume that the 7-segment LEDs are turned on with l
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:331706
    • 提供者:vinay
  1. finial_test

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  2. 卷积码和Viterbi译码的源程序,在Xilinx ISE环境下使用Verilog编写,有助于卷积码和Viterbi译码的学习-Convolutional codes and Viterbi decoding of the source, in the Xilinx ISE environment, use of Verilog prepared to help convolutional codes and Viterbi decoding of the study
  3. 所属分类:VHDL编程

    • 发布日期:2013-11-13
    • 文件大小:5588970
    • 提供者:lxz
  1. VHDL-tutorial-codes

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  2. VHDL tutorial ccodes
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-01
    • 文件大小:14675
    • 提供者:siavosh
  1. FPGA-convolutions-encoder

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  2. 卷积码是数字通信中很重要的一种差错控制编码 具有很好的性能,用硬件的形式描述具有速度快,便于修改的优点,通过该种方法设,计的编码器经测试运行可靠正确。-Convolutional codes are very important in digital communication error control coding with a good performance, with the descr iption of the hardware in the form of a fast, eas
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:3844
    • 提供者:will li
  1. code

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  2. this file is the vhdl codes for floating point multiplier.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-24
    • 文件大小:33078
    • 提供者:elahe
  1. round_nearest

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  2. this file is vhdl codes for rounding the floating point number to nearest number.it is useful for floating point multiplier.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:140980
    • 提供者:elahe
  1. wallacetree8

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  2. this file is vhdl codes for wallacetree multiplier.it is useful for 8*8 wallacetree multiplier.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-01
    • 文件大小:713604
    • 提供者:elahe
  1. BCH

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  2. BCH码是循环码中的一个重要子类,它具有纠正多个错误的能力,广泛应用于移动通信和卫星通信中。BCH码有着严密的代数结构,是目前研究得比较透彻的一种码。-BCH codes are cyclic codes is an important sub-class, it has the ability to correct multiple errors, widely used in mobile communications and satellite communications. BCH co
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-27
    • 文件大小:61259
    • 提供者:wangzhi
  1. 15Turbo

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  2. urbo码是1993年法国人Berrou提出的一种新型编码方法。它巧妙的将卷积码和随机交织器结合在一起;同时,采用软输出迭代译码来逼近最大似然译码-urbo code is 1993 French Berrou proposed a new encoding method. It is clever to convolutional codes and random interleaver together the same time, the use of soft-output itera
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-16
    • 文件大小:62861
    • 提供者:wangzhi
  1. New-folder

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  2. VHDL codes for booth , nco and some more
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-04
    • 文件大小:1918
    • 提供者:Ashwin
  1. New-folder

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  2. Vhdl codes for D flip flop and so
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:767
    • 提供者:Ashwin
  1. New-folder

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  2. VHDL codes for analog to digital converter
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:534
    • 提供者:Ashwin
  1. VHDL-PID

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  2. PID Controller VHDL. It provides codes for both proportional, integral and derivative. It can be used for motor speed control, light control and others
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-05
    • 文件大小:12400
    • 提供者:Suleiman
  1. VLSI-FINAL-MANUAL

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  2. vlsi manual helps to engineering students for vhdl codes of some practicals
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-30
    • 文件大小:131918
    • 提供者:malhar
  1. scrambler-wimax

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  2. This package contains synthesizable VHDL codes for scramber/descrambler module for IEEE 802.16 WiMAX PHY layer.
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-06
    • 文件大小:1254
    • 提供者:zpatel
  1. Example-codes

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  2. example code of vhdl
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-22
    • 文件大小:6705887
    • 提供者:senthilraj
  1. 7-4-linear-space-time-block-codes-

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  2. 7-4线性分组码编码器 vhdl描述-7-4 linear space-time block codes encoder vhdl derect
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-25
    • 文件大小:185793
    • 提供者:郭少华
  1. 113070047_Lab3.tar

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  2. VHDL codes implementing Full adder and Comparator
  3. 所属分类:Other systems

    • 发布日期:2017-04-24
    • 文件大小:168899
    • 提供者:Parvathy
  1. vhdl

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  2. implementation of VHDL source codes for different projects
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-14
    • 文件大小:4018
    • 提供者:raj
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