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  1. resolutionquartusII

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  2. 用verilog编写的分辨率提高的源代码 采用双线性插值-Written resolution with the verilog source code to improve the use of bilinear interpolation
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-05-21
    • 文件大小:5.95mb
    • 提供者:权晶
  1. video_stream_scaler

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  2. Verilog HDL实现双线性插值视频实时缩放,源码及说明文档-Verilog HDL bilinear interpolation real-time zoom, video source and documentation
  3. 所属分类:Special Effects

    • 发布日期:2017-05-20
    • 文件大小:5.38mb
    • 提供者:
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