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DSP做的视频处理系统中FIFO问题解答
- DSP做的视频处理系统中FIFO问题解答-DSP video processing system FIFO Questions
main
- DSP通过EMIF接口与外部FIFO通信并实现IQ调制功能
DSP_2812_SCI_232
- DSP2812串口通信编程，利用FIFO中断接收数据以及利用查询方式发送数据-TMS320F2812SCI code
video_process_base_on_DSPandFPGA
- 基于高速数字信号处理器(DSP) 和大规模现场可编程门阵列( FPGA) ,成功地研制了小型 化、低功耗的实时视频采集、处理和显示平台. 其中的DSP 负责图像处理,其外围的全部数字逻辑功能都集成在一片FPGA 内,包括高速视频流FIFO、同步时序产生与控制、接口逻辑转换和对视频编/ 解码器进行设置的I2 C 控制核等. 通过增大FIFO 位宽、提高传输带宽,降低了占用EMIF 总线的时间 利用数字延迟锁相环逻辑,提高了显示接口时序控制精度. 系统软件由驱动层、管理层和应用层组成,使得硬件管
FIFO
- it is a verilog code written for FIFO in modelsim simulator and it will synthesize in xinlix ise 8.2i.i have tested it om my kit.[i mae my own kit for spartan2 device].you can use this code in any DSP project in which data entry is required.-it is a
FIFOSRC
- DSP uart窗口通信中的一种通信格式，FIFO模式的一个小程序-dsp serial communication uart communication first in first out-FIFO mode
DSP2812FIFO
- DSP上实现 软件FIFO队列 提高SCI的数据缓冲能力-DSP to achieve the software improve the SCI data FIFO queue buffering capacity
dsp_circular_buffer.tar
- FIFO circular buffer for DSP
DSP6713
- 包括定时器、SPI、SDRAM、Flash、FIFO等程序，均调试通过-SPI\SDRAM\Flash\FIFO\timer for DSP6713
SCIA_FIFO
- DSP2812串口SCIA数据FIFO接收、发送-Receive FIFO serial SCIA data send
SCI_485
- 文档时我最近编写的DSP的SCI通信，采用的485，通信速率达到1.5Mb/s，采用的FIFO功能。-I recently prepared a document of the SCI communication DSP, using the 485, communication rates up to 1.5Mb/s, using the FIFO function.
rty
- 近年来，随着DSP的快速发展，被广泛的应用于图像处理及目标定位[11][13][21]上，极大地提高图像处理的实时性。DSP主要用来实现扩展算法和数字信号处理的功能，其最典型的用途是实现数字图像处理算法。DSP芯片内采用大容量的SRAM作为系统的高速缓存，高达64位的数据总线带宽。在片外采用了目前流行的SDRAM、DDR2等高速大容量存储器的无缝连接，同时还支持SRAM、FIFO等各种类型的存储器，大大提高了图像的存储容量及速度。-In recent years, with the rapid
s
- 近年来，随着DSP的快速发展，被广泛的应用于图像处理及目标定位[11][13][21]上，极大地提高图像处理的实时性。DSP主要用来实现扩展算法和数字信号处理的功能，其最典型的用途是实现数字图像处理算法。DSP芯片内采用大容量的SRAM作为系统的高速缓存，高达64位的数据总线带宽。在片外采用了目前流行的SDRAM、DDR2等高速大容量存储器的无缝连接，同时还支持SRAM、FIFO等各种类型的存储器，大大提高了图像的存储容量及速度。-In recent years, with the rapid
fifo
- 完成整个Wimax的上下行的基带算法的DSP的源代码-The code for wimax downlink
fifo
- CAN总线，DSP+FPGA+SJA1000架构，FPGA负责逻辑设计,此文件内有FPGA负责dsp和sja1000通信-CAN bus, DSP+ FPGA+ SJA1000 architecture, FPGA logic is responsible for the design, FPGA is responsible in this document have dsp and sja1000 Communications
FIFO
- FPGA TI DSP的EMIF接口的地址总线问题-FPGA FIFO
SCI-FIFO--(RS485)
- 利用DSP的开发工具CCS实现了RS485总线的数据收发功能，并以此和触摸屏通讯-DSP RS485 HMI
DSP读写基于FPGA的FIFO
- 本文档提供了DSP对FPGA中的FIFO的读写时序以及编程思路，供大家参考。(This document provides DSP on the FPGA FIFO read and write timing and programming ideas for your reference.)
Example_2833x_i2c_ds1338_fifo
- 基于DSP23885访问eeprom读写FIFO(DSP23885,access to eeprom)
Example_2833x_i2c_ds1338
- 基于DSP28335直接访问eeprom,没有fifo(There is no FIFO to access EEPROM directly based on DSP28335)