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搜索资源列表

  1. ECHOR

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  2. GW48系统电子琴:可控制8个音节,4种音调 readme中带使用说明-GW48 system : control eight syllables, four species of taking the pitch readme use
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:2.69kb
    • 提供者:张建
  1. FPGA_SONGER

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  2. 基于FPGA的乐曲硬件演奏电路设计的实现,有完整的VHDL代码,并有PDF详细说明如何下载及跳线设置,并“梁祝”在GW48系列开发平台上下载调试成功。音乐优美-FPGA-based hardware music concert circuit design to achieve a complete VHDL code. and a detailed account of how the PDF download and set up the jumper, and "Butterfl
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:729.36kb
    • 提供者:wyy
  1. FPGA_TENNIS

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  2. 基于FPGA的乒乓球游戏硬件电路的设计与实现,有完整的VHDL代码,并有PDF详细说明如何下载及跳线设置,并在GW48系列开发平台上下载调试成功-FPGA-based table tennis game hardware circuit design and realization of a complete VHDL code. and a detailed account of how the PDF download and jumper settings and in a series
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:304.02kb
    • 提供者:wyy
  1. pinlvji

    0下载:
  2. 此程序基于gw48开发系统的实验频率计,无需修改即可编译运行。其他平台稍加修改同样适用
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:1.26kb
    • 提供者:孙健
  1. SINGT

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  2. 正弦信号发生器源文件,已经成功运行,机箱是GW48系列EDA实验开发系统
  3. 所属分类:其它

    • 发布日期:2008-10-13
    • 文件大小:214.48kb
    • 提供者:Alex
  1. Verilog(piano)

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  2. 用VERILOG语言编写的电子琴程序.用GW48教学实验箱仿真的
  3. 所属分类:VHDL编程

    • 发布日期:2008-10-13
    • 文件大小:5.32kb
    • 提供者:阿洪
  1. Verilog(clock)

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  2. 用VERILOG语言编写的电子钟程序.是用GW48教学实验箱仿真
  3. 所属分类:单片机(51,AVR,MSP430等)

    • 发布日期:2008-10-13
    • 文件大小:7.39kb
    • 提供者:阿洪
  1. VHDL

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  2. 1、 设计一个简易电子琴。要求能演奏的音域为中音的 1 到高音的 1。 2、 用GW48-PK2中的8个按键作为琴键。 3、 GW48-PK2中有扬声器。 4、 可以使用GW48-PK2上的12MHz作为输入时钟信号。 -1, the design of a simple flower. Requirements can play for the tenor of the range of 1 to treble the 1.2, and GW48-PK2 in eight ke
  3. 所属分类:Other systems

    • 发布日期:2017-04-03
    • 文件大小:30.29kb
    • 提供者:朱磊
  1. VHDL_electronic_organ

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  2. 简易电子琴,可以弹奏音乐。本课程设计主要内容是基于VHDL语言并利用数控分频器设计硬件电子琴,利用GW48作为课程开发硬件平台,键1至键8设计为电子琴键。某一个LED显示当前的按键的音节数。-Simple organ, can play music. The main contents of this curriculum design is based on the VHDL language and the use of digital hardware design divider org
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-29
    • 文件大小:260.57kb
    • 提供者:lsb
  1. aqz

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  2. a:闲置不用GW48 EDA/SOC系统时,关闭电源,拔下电源插头!!! b:EDA软件安装方法可参见光盘中相应目录中的中文README.TXT;详细使用方法可参阅本书或《EDA技术实用教程》、或《VHDL实用教程》中的相关章节。 c:在实验中,当选中某种模式后,要按一下右侧的复位键,以使系统进入该结构模式工作。 d:换目标芯片时要特别注意,不要插反或插错,也不要带电插拔,确信插对后才能开电源。其它接口都可带电插拔(当适配板上的10芯座处于左上角时,为正确位置)。 e
  3. 所属分类:Windows Develop

    • 发布日期:2017-04-10
    • 文件大小:1.12kb
    • 提供者:张于
  1. asdf

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  2. 附图1-1A为GW48-CK型EDA实验开发系统的主板结构图(GW48-GK/PK型未画出,具体结构说明应该参考实物主板),该系统的实验电路结构是可控的。即可通过控制接口键SW9,使之改变连接方式以适应不同的实验需要。因而,从物理结构上看,实验板-Figure 1-1A for the GW48-CK-type EDA experimental development system board structure (GW48-GK/PK type does not draw, the speci
  3. 所属分类:BREW

    • 发布日期:2017-03-31
    • 文件大小:920byte
    • 提供者:张于
  1. EDA

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  2. EDA实验讲义GK 包含GW48 EDA系统使用说明以及许多实例。比如有时钟使能的两位十进制计数器原理图输入设计、用状态机对ADC0809的采样控制电路实现、硬件电子琴电路设计-EDA experimental GK notes GW48 EDA system contains, as well as many examples of use. For example, there are two clock-enabled input decimal counter schematic des
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-08
    • 文件大小:153.67kb
    • 提供者:lsp
  1. edaDesign

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  2. 电子电路分析与设计(EDA软件应用二)MAX+plusII应用 第一章 GW48 EDA系统使用说明 第二章 原理图输入设计方法 第三章 VHDL设计初步 第四章 实验-Electronic Circuit Analysis and Design (EDA software application 2) MAX+ plusII Chapter GW48 EDA application system for use Chapter schematic design VHDL des
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-03
    • 文件大小:348.38kb
    • 提供者:杜尘
  1. 1[1]

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  2. 设计并调试好一个由两个4 位二进制并行加法器级联而成的8 位二进制并行加法器,并 用GW48-CK EDA 实验开发系统(拟采用的实验芯片的型号为EPF10K10LC84-3)进行硬件 验证。-vhdl
  3. 所属分类:assembly language

    • 发布日期:2017-04-17
    • 文件大小:426.59kb
    • 提供者:
  1. SCAN_LED

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  2. 使用GW48平台模式5测试,可以使LED灯轮流扫描显示-5 test using GW48 platform mode, you can make LED lights turn scan shows
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-02
    • 文件大小:166.73kb
    • 提供者:盘明
  1. VHDL_piano

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  2. 用VERILOG语言编写的电子琴程序.用GW48教学实验箱仿真的-Using Verilog language organ procedures. GW48 teaching experiment with simulation boxes
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-15
    • 文件大小:5.51kb
    • 提供者:薛鹏展
  1. FPGA-based-multi-Divider

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  2. 分频器是指使输出信号频率为输入信号频率1/N的电子电路,N是分频系数。在许多电子设备中如电子钟、频率合成器等,需要各种不同频率的信号协同工作,常用的方法是以稳定度高的晶体振荡器为主振源,通过变换得到所需要的各种频率成分,分频器是一种主要变换手段。 本文当中,在分析研究和总结了分频技术的发展趋势的基础上,以实用、可靠、经济等设计原则为目标,介绍了基于FPGA的多种分频器的设计思路和实现方法。本设计采用EDA技术,以硬件描述语言VHDL为系统逻辑描述手段设计文件,在QuartusⅡ工具软件环境下
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-03-31
    • 文件大小:4.59kb
    • 提供者:吴红梅
  1. VVerrilogclloe

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  2. 用VERILOG语言开发的电子钟程序源码码.是用GW48教学实验箱仿真 -Electronic clock with VERILOG language program source code. GW48 teaching experiment box simulation
  3. 所属分类:Windows Develop

    • 发布日期:2017-03-30
    • 文件大小:7.18kb
    • 提供者:条款
  1. code

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  2. 设计RS、JK、D、T 四种触发器,掌握异步复位置位的方法以及四种触发功能的实现方 法,掌握QuartusII 软件的使用方法以及GW48 型SOPC 开发平台中的输入输出模式配置方 法。 -Design RS, JK, D, T four kinds of triggers, grasp complex bit asynchronous methods and how to configure four trigger implementation function Quartu
  3. 所属分类:VHDL-FPGA-Verilog

    • 发布日期:2017-04-11
    • 文件大小:742byte
    • 提供者:张双图
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