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  1. sdr-sdram-(verilog)

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  2. Altera的SDR SDRAM模型,verilog实现,带说明书文件以及仿真文件、SDRAM原型文件。-Altera' s SDR SDRAM model, verilog implementation, with manual files and simulation files, SDRAM prototype file.
  3. 所属分类:VHDL编程

    • 发布日期:2016-11-15
    • 文件大小:759.18kb
    • 提供者:左左
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