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  1. VerilogA_Compact_Model_Extensions

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  2. 采用wverilog-a描述模型的主要方式-Wverilog-a descr iption of the use of the main form of model
  3. 所属分类:ActiveX-DCOM-ATL

    • 发布日期:2017-04-25
    • 文件大小:99.77kb
    • 提供者:jj
  1. verilog-A_library

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  2. Complete Verilog-A library for analog blocks, like ADC, DAC, amplifiers
  3. 所属分类:Other systems

    • 发布日期:
    • 文件大小:79.34kb
    • 提供者:zhanglh
  1. iverilog-0.9.2

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  2. iverilog是verilog仿真综合工具,能够将verilog源代码编译为不同的目标文件-Icarus Verilog is a Verilog simulation and synthesis tool. It operates as a compiler, compiling source code writen in Verilog (IEEE-1364) into some target format
  3. 所属分类:Embeded-SCM Develop

    • 发布日期:2016-01-24
    • 文件大小:1.41mb
    • 提供者:fanyuchuan
  1. verilog_a_modeling

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  2. verilog-a 建模,在Cadence 中建立一个二级运放的VerilogA行为级模型,并进行建立时间等等仿真,以及对S/H电路的建模和仿真。 -verilog-a model in Cadence to create a secondary op amp VerilogA behavioral model and the simulation set-up time, etc., as well as S/H circuit modeling and simulation.
  3. 所属分类:VHDL编程

    • 发布日期:2013-09-04
    • 文件大小:1.95mb
    • 提供者:史培霖
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