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一个8位的十进制频率计数器,功能经过测试.-An 8-bit decimal frequency counter, function tested.
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数控分频器的设计数控分频器
端口定义：
CLK：时钟输入
D[7..0]：预置数据
Fout：分频输出
说明：
D[7..0]作为8位加1计数器的初值，初值越大，分频输出频率越高，反之越低，
-NC NC divider divider port the definition of design: CLK: Clock input D [7 .. 0]: preset data Fout: frequency output that: D [7 .. 0] as
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以把直接数字频率合成（DDS）看成这样一种技术，它能用数字值形式的信号控制正弦波的频率。最简单的DDS电路包括一个二进制计数器，一个以等间隔正弦波值进行全波编程的ROM，以及一个数模转换器，用于将存储的正弦波值转换为电压。计数器的时钟频率决定了正弦波的频率，但这
-To the Direct Digital Synthesis (DDS) as such a technology, it can use the digital value of the form of the frequen
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频率计，自动记录信号波形，宽频，四位，自动换挡-Frequency counter, automatic recording signal waveform, broadband, 4, auto-shift
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一个简单大家容易看的懂的频率计设计程序，可以实现自动换挡功能。-A simple and easy to see to understand all of the frequency counter design program that can automatically shift feature.
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bcd十进制计数器，用于频率计设计的计数器单元，输出zeros用于选通量程使用！-bcd decimal counter, the counter for frequency counter design unit, the output zeros for the use of strobe range!
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测量频率的方法有多种,其中电子计数器测量频率具有精度高、使用方便、测量迅速，以及便于实现测量过程自动化等优点，是频率测量的重要手段之一。-Measuring the frequency of means, including electronic counter to measure frequencies with high precision, easy to use, fast measurement and easy to realize the advantages of automa
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数字逻辑课程设计频率计数器（VHDL） CSDN 下载频道
-Digital Logic Course Design frequency counter (VHDL) CSDN download channel
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vhdl code which implement a six binary counter, with adjustable frequency.this module is tested in Quartus tool of ALTERA.
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this code vhdl of an binary counter with adjustable frequency
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用VHDL语言实现频率计功能，加载到FPGA可以立即实现-With VHDL frequency counter function can be realized immediately loaded into the FPGA
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VHDL代码，一些课本的小程序。包含3线-8线译码器，4选1选择器，6层电梯，8线-3线编码器，8线-3线优先编码器，8选1，BCD-7段显示译码器真值表，半加器，摩尔状态机，数字频率计，数字时钟，同步计数器，序列检测器的设计，序列信号发生器，一般状态机等等。(The small program of some textbooks. Includes 3 -8 decoder, 4 1 selector, 6 elevator, line 8 Line 8 line -3 encoder, -3
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在ise软件上，用VHDL语言，设计的数字跑表，可以两位计数，含分频器，计数器(In the ISE software, using VHDL language digital stopwatch design, can two counts, including frequency divider, counter)
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使用vhdl语言原件例化设计数字频率计，并用6位7段数码管计数。模块包括：十进制计数器，6位10进制计数器，Reg24 锁存器、Fp 分频器、Ctrl 频率控制器、Disp 动态显示。(The digital frequency meter is designed by using VHDL language as an example and counted by 6-bit 7-segment digital tube. Modules include: decimal counter, 6
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